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各位大神,请教一个问题。目前正在使用Xilinx新出的Vivado 软件生成DMA和PCIE集成的IP核,在此基础上又生成了一个example design,但是在仿真的时候报错。是Xilinx的这款产品不够成熟还是我操作有错误??各位大神有没有遇到此类问题的??
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