完善资料让更多小伙伴认识你,还能领取20积分哦, 立即完善>
扫一扫,分享给好友
本帖最后由 无人可以安眠 于 2015-5-16 20:38 编辑
我现在想做一个数字跑表,clk_f为50MHZ时钟输入,在模块内部做分频后产生1khz的clk信号,***设置大一点(因为输出包含msec,sec,min,h),但最大只能到100us,无法进一步延长,请问这是为什么,是不是我的设置出了什么问题?
|
|
相关推荐
1个回答
|
|
我想问下那个13版的end time在哪里找?
|
|
|
|
你正在撰写答案
如果你是对答案或其他答案精选点评或询问,请使用“评论”功能。
小黑屋| 手机版| Archiver| 电子发烧友 ( 湘ICP备2023018690号 )
GMT+8, 2024-10-16 21:13 , Processed in 0.358263 second(s), Total 40, Slave 32 queries .
Powered by 电子发烧友网
© 2015 bbs.elecfans.com
关注我们的微信
下载发烧友APP
电子发烧友观察
版权所有 © 湖南华秋数字科技有限公司
电子发烧友 (电路图) 湘公网安备 43011202000918 号 电信与信息服务业务经营许可证:合字B2-20210191 工商网监 湘ICP备2023018690号