怎么将模拟数据写入文件

嗨，
我的代码文件写入操作被复制到下面。请看代码。如果有任何问题请告诉我。我在这些变量中获取数据，如image_s＆amp;
image_vld_s。
如果我删除了文件夹中的mac_data.dat文件，它也将在代码运行时创建。
但是这些数据没有写入文件。
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*******************文件mac_data：文本打开write_mode是“D： Xilinx  Mahesh_Project  Sensor_Capture_Codes  mac_data.dat”;  -  *******
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**********  - 将像素数据写入“mac_data.txt”文件的过程 -  ***********************
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********************************************程序edg_data_write（信号rx_clk_int：
在std_logic中;  -  chsnged clk到rx_clk_int信号image_vld_s：在std_logic中;  - 将pxl_vld_s更改为image_vld_s信号image_s：在std_logic_vector中（7 downto 0）;  - 将edge_signal_s更改为image_s信号op_array_s：out op_array_1; signal pix_cnt：out integer）
是变量index_s：integer：= 0;变量edg_sig：std_logic_vector（7 downto 0）;变量pxl_line_wr：line;类型op_array是数组（0到（（NO_OF_COLUMNS * NO_OF_ROWS）-1））o
f整数;  - （（NO_OF_COLUMNS * NO_OF_ROWS）-1））整数;变量op_array_v：op_array; begin --edg_sig：= edge_signal_s +“01111111”;
对于j in 0到（NO_OF_ROWS-1）循环等到image_vld_s ='1';  - 等到（rx_clk_int'event和rx_clk_int ='1'）;
for i in 0 to（NO_OF_COLUMNS-1）loop op_array_v（index_s）：= conv_integer（image_s）;
- 将edge_signal_s更改为image_s op_array_s（index_s）index_s：= index_s + 1;
pix_cnt等到（rx_clk_int'event和rx_clk_int ='1'）;
结束循环;
结束循环;
for i in 0 to（（NO_OF_COLUMNS * NO_OF_ROWS）-1）循环写入（pxl_line_wr，op_array_v（i））;
writeline（mac_data，pxl_line_wr）;
等到rising_edge（rx_clk_int）;
结束循环;
结束edg_data_write;  -  *********************************************
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感谢你，Mahesh Hegde。



以下为原文

Hi,
          My file writing operation of code is copied below.Please see the code.If any problems please tell me.I am getting the data in these variables like image_s & image_vld_s.
If i deleted the mac_data.dat file in the folder also it ll be created when code is running.
But these data is not writing into the file.
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file mac_data    : text open write_mode is "D:XilinxMahesh_ProjectSensor_Capture_Codesmac_data.dat";

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--procedure to write pixel data to the "mac_data.txt" file
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procedure edg_data_write ( signal rx_clk_int    : in  std_logic;             -- chsnged clk to rx_clk_int
               signal image_vld_s   : in  std_logic;             -- changed pxl_vld_s to image_vld_s
               signal image_s    : in  std_logic_vector(7 downto 0);  -- changed edge_signal_s to image_s
               signal op_array_s    : out op_array_1;
               signal pix_cnt    : out integer
              ) is
              
variable index_s    : integer:=0;
variable edg_sig    : std_logic_vector(7 downto 0);
variable pxl_line_wr: line;
type op_array is array (0 to ((NO_OF_COLUMNS*NO_OF_ROWS)-1)) of integer;--((NO_OF_COLUMNS*NO_OF_ROWS)-1)) of integer;
variable op_array_v : op_array;
begin  
--edg_sig:=edge_signal_s+"01111111";
    for j in 0 to (NO_OF_ROWS-1) loop
       wait until image_vld_s ='1';
--       wait until (rx_clk_int'event and rx_clk_int = '1');
       for i in 0 to(NO_OF_COLUMNS-1) loop
          op_array_v(index_s):= conv_integer(image_s);             -- changed edge_signal_s to image_s
          op_array_s(index_s)<= conv_integer(image_s);             -- changed edge_signal_s to image_s
          index_s := index_s+1;
          pix_cnt <=index_s;         
          wait until (rx_clk_int'event and rx_clk_int = '1');
       end loop;
   end loop;
for i in 0 to ((NO_OF_COLUMNS*NO_OF_ROWS)-1) loop
   write(pxl_line_wr, op_array_v(i));
   writeline(mac_data, pxl_line_wr);
   wait until rising_edge(rx_clk_int);   
end loop;
end edg_data_write;
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Thanks You in Advance,
Mahesh Hegde.