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PCIe链路层里的ACK/NAK介绍 2023-06-25 10:31

✎ 编者按读cocotbext-pcie源码，有部分牵涉到数据链路层。虽然自工作以来接触到PCIe还是蛮多的，但一般往往专注在TLP层，对于数据链路层还是接触的比较少的。PCIe Spec洋洋洒洒数千页，也不会从头到尾去通读整个协议。对于cocotbext-pcie里面牵涉到的链路层的ACK/NAK，牵涉到的PCIe背景，聊做记录。本文仅结合PCIe Spce与cocotbext-pcie做记录。》ACK/NAK 与TCP协议般，PCIe协议在数据链路层采用滑动窗口ACK/NAK协议来保证数据传输。对于传输层

hongdadianyuan

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简单地分析几个Ack/Nak机制的例子 2018-05-30 09:16

设备B接收到了TLP4095，但是该TLP并未通过CRC校检（即存在错误）。此时无论AckNak_LATENCY_TIMER处于何种状态，设备B都会立即向设备A返回Ack4094（注意返回的Ack DLLP中的序列号为上一次成功接收的TLP的序列号）。同时设备B将AckNak_LATENCY_TIMER停止并复位；

SwM2_ChinaAET

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芯片性能小谈—时间并行 2023-06-27 16:04

众所周知，评估一颗芯片的好坏，PPA(performance，power，area)是最重要的指标之一。

冬至子

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【CHI】独占访问 2023-10-31 14:11

独占访问的原则是，执行独占序列的逻辑处理器（LP）执行以下操作

冬至子

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CXL.mem是什么？ 2022-11-02 09:45

内存QoS遥测是内存设备的一种机制，用于在CXL.mem请求的每个响应消息中指示其当前负载级别（DevLoad）。这使主机能够根据负载级别来衡量对部分设备、单个设备或设备组的CXL.mem请求的速率，从而优化这些内存设备的性能，同时限制结构拥塞。

7zsH_Ithingedu

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一文详解CXL.cache协议 2022-10-17 10:46

通常，所有CXL.cache通道都必须彼此独立工作。然而，有一个特例，为了保证正确性，必须维护通道之间的顺序。主机需要等待设备观察到H2D响应上发送的全局排序（GlobalOrdering，GO）消息，然后再发送相同地址的后续监听。

7zsH_Ithingedu

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先详解CXL系统架构 2022-09-14 09:10

CXL设备扩展限制只允许每个VH（Virtual Hierarchy）启用一个Type 1或Type 2设备。

7zsH_Ithingedu

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