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Xilinx SelectIO资源内部的IDELAYE2应用介绍
2024-4-26 11:33

本文我们介绍下Xilinx SelectIO资源内部IDELAYE2资源应用。IDELAYE2原句配合IDELAYCTRL原句主要用于在信号通过引脚进入芯片内部之前，进行延时调节，一般高速端口信号由于走线延时等原因，需要...

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Xilinx FPGA BGA推荐设计规则和策略（二）
2024-5-1 10:45

工程师必须在设计阶段早期评估功率需求，以确保有足够的层和面积为需要功率的BGA焊盘提供足够的功率。...

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Vivado编译常见错误与关键警告梳理与解析
2024-4-15 11:38

Xilinx Vivado开发环境编译HDL时，对时钟信号设置了编译规则，如果时钟由于硬件设计原因分配到了普通IO上，而非_SRCC或者_MRCC专用时钟管脚上时，编译器就会提示错误。...

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XC7K410T-FFG900外设之DDR3硬件设计方案分享
2024-4-12 10:03

在数据速率带宽约束方面，DDR3运行速度受限于其与K7-410T FPGA互联的I/O Bank 管脚以及FPGA器件的速度等级。...

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基于Xilinx K7-410T的高速DAC之AD9129开发笔记（二）
2024-1-14 09:28

上一篇文章我们简单介绍了AD9129的基础知识，包括芯片的重要特性，外部接口相关的信号特性等。本篇我们重点介绍下项目中FPGA与AD9129互联的原理图设计，包括LVDS IO接口设计、时钟电路以、供电设计以及PCB设计...

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基于Xilinx K7-410T的高速DAC之AD9129开发笔记
2023-6-7 10:24

引言：从本文开始，我们介绍下项目中设计的并行LVDS高速DAC接口设计，包括DAC与FPGA硬件接口设计、软件设计等。项目设计高速DAC采用了ADI公司的AD9129，该芯片最大更新速率5.7Gsps，该芯片在宽带通信应...

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基于TXS0108实现FPGA IO Bank接不同外设IO接口电压转换
2023-5-16 09:02

引言：上一篇文章我们介绍了通过添加电阻器、场效应晶体管（FET）开关、电平转换器甚至其他Xilinx FPGA等选项实现HP Bank IO与2.5V/3.3V外设对接的方法。本文介绍利用TI公司TXS0108实现FPG...

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串行配置和并行配置模式下的多片FPGA配置数据流加载方式
2023-2-20 10:18

在需要多个FPGA芯片的应用中，如果JTAG链上所有FPGA采用相同配置，可以通过“成组”加载方式同时加载；...

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提高Xilinx FPGA Flash下载速度
2023-2-14 10:15

最近在编写完FPGA逻辑，成功生成.bin文件后，发现将数据流文件烧写到Flash时间过长，突然想起可以通过Vivado软件进行设置，提高烧写速度。...

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Matlab算法映射至FPGA硬件逻辑
2023-1-30 17:37

引言：本文分享一篇技术PPT，该PPT主要介绍如何将算法映射到FPGA或ASIC硬件架构。...

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