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jf_14112271

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发布了问题 2021-4-11 01:30

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菜鸟求助

jf_14112271
学生

我是FPGA小白，在室友quartus的时候，我用HDML编写了一个动态显示数码管的程序，编译和烧录进FPGA开发版都成功了，但是在进行波形仿真的时候却没有正确的仿真结果，如下图所示（已经在程序中关闭了原本的时钟信号） ...

来源：FPGA|CPLD|ASIC论坛

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