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山东济南丨设计开发工程

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下载了资料 2024-7-3 16:58

基于FPGA的LVDS接口应用

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评论了资料 2024-7-2 14:17

ADS7886实用FPGA驱动代码

henry_xia37
总经理 Chord-elec

input RST;  //复位按键input SDI;  //AD数据通信输入,对应连接AD的SDOinput c0;   //锁相环产生的信号input start; //开始采样信号output SCLK; //给AD的时钟信号output CS;   //片选output [11:0]DATAOUT;   //输出数据reg [5:0]timecnt;     //计数器，记录一个采集周期的脉冲数，16个采集脉冲，3个CS拉高非采集脉冲（数据手册）reg [5:0]timecnt_n;   //计数器下个状态reg CS;reg CS_N;reg [11:0]DATA;       //数据寄存器reg [11:0]DATA_N;reg [11:0]DATAOUT;       //数据输出寄存器reg [11:0]DATAOUT_N;我想找个LVDS的，不好找啊
关注了用户 2024-7-2 13:47

肖升泰

硬件工程师湖南于正智能科技有限公司
湖南省长沙市 | 设计开发工程
关注数 0 粉丝数 1
收藏了帖子 2024-7-2 13:47

1

altera有没有办法实现xilinx的IOBUFDS的办法？

肖升泰
硬件工程师湖南于正智能科技有限公司

问题：采用altera公司的ep4ce6e22c8控制器的一对差分引脚实现差分输入输出配置功能尝试方法：尝试配置LVDS IP核，但发现只有单独的输入输出，如图 ...

来源：FPGA|CPLD|ASIC论坛标签： Xilinx Altera
下载了资料 2024-7-2 13:46

Altera参考设计

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具有LVDS输出的LTM9011 ADC的AN147-Altera Stratix IV FPGA接口

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