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mdy吴伟杰

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发布了帖子 2019-8-7 09:05

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FPGA数码管动态扫描

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数码管动态扫描一、项目背景led数码管（LED Segment Displays）是由多个发光二极管封装在一起组成“8”字型的器件，引线已在内部连接完成，只引出它们的各个笔划，公共电极。led数码管常用段数一般为7段，如上图中 ...

来源：FPGA|CPLD|ASIC论坛标签： FPGA
发布了帖子 2019-8-6 09:02

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基于FPGA至简设计法的4位闪烁灯

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4位闪烁灯一、项目背景LED灯的理论、教学板的原理图，已经在案例1位闪烁灯中有详细的描述，在此不再讲述，有兴趣的读者可以返回去阅读。二、设计目标本工程使用4个LED灯---LED1~LED4，实现一个呼吸灯的功能。这4个 ...

来源：FPGA|CPLD|ASIC论坛标签： FPGA
发布了帖子 2019-8-2 08:47

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FPGA至简设计法案例4

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FPGA至简设计法案例4至简设计法经典案例4 案例4. 当收到en=1时，dout间隔1个时钟后，产生2个时钟周期的高电平脉冲，并且重复3次。上面波形图显示了描述的功能。第3个时钟上升 ...

来源：FPGA|CPLD|ASIC论坛
发布了帖子 2019-8-1 08:45

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FPGA至简设计法经典案例3

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至简设计法经典案例3 案例3. 当收到en1=1时，dout产生3个时钟周期的高电平脉冲；当收到en2==1时，dout产生2个周期的高电平脉冲。上面波形图显示了描述的功能。第3个时钟上升沿收到en1==1，所以dout变1并且持续3 ...

来源：FPGA|CPLD|ASIC论坛标签： FPGA
发布了帖子 2019-7-31 08:56

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FPGA至简设计法案例2

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至简设计法经典案例2 例2. 当收到en=1后，dout间隔3个时钟后，产生宽度为2个时钟周期的高电平脉冲。如上面波形图所示，在第3个时钟上升沿看到en==1，间隔3个时钟后，dout变1，再过2个时钟后，dout变0。根据案例1的 ...

来源：FPGA|CPLD|ASIC论坛标签： FPGA
发布了帖子 2019-7-30 08:33

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FPGA经典设计案例

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至简设计法经典案例学习FPGA，最关键的是学什么？有读者学了大半年时间的FPGA，学了串口就只懂串口的设计，学了SPI就只懂SPI接口的设计。每个接口、每个功能，都只是学一个懂一个。换个功能需求，或者对接口做一个 ...

来源：FPGA|CPLD|ASIC论坛标签： FPGA
发布了帖子 2019-7-29 08:56

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FPGA整洁代码之道3-信号命名和定义应该明确

mdy吴伟杰
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FPGA整洁代码之道3-信号命名和定义应该明确在设计中，我们不断的给目录、源代码、文件、函数、变量、参数、类、封包进行命名与定义。当一件工作需要进行的次数非常之多，足以证明它是不可或缺的基本工作。我们一定 ...

来源：FPGA|CPLD|ASIC论坛标签： FPGA
发布了帖子 2019-7-26 08:50

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FPGA设计代码整洁之道2

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《极限编程实施》作者Ron Jeffries 仔细研究了贝克的简单代码规则，并依其重要顺序分别列为：＆能通过所有测试＆没有重复代码＆体现系统中的全部涉及理念＆ & ...

来源：FPGA|CPLD|ASIC论坛标签： FPGA
发布了帖子 2019-7-25 09:40

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FPGA设计干净的代码是程序员的核心技能

mdy吴伟杰
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线下课程推荐：课程名称：FPGA周末班，快速入门FPGA课程链接：http://url.elecfans.com/u/97edd21e88 在正式开始之前，我们先看看一位FPGA工程师的工作日常：开始设计代码开始写第一个always代码发现要增加一个信 ...

来源：FPGA|CPLD|ASIC论坛标签： FPGA
发布了帖子 2019-7-24 12:00

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至简设计原理与应用目录

mdy吴伟杰
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至简设计原理与应用目录简介：本书收集整理了作者在FPGA项目实践中的经验点滴。既有常用FPGA设计技巧；也有多个项目案例分析，小到闪烁灯，大到边缘检测，AD采集等项目，并且这些案例大都以特定的工 ...

来源：FPGA|CPLD|ASIC论坛

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