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dbuK_Lauren_FPG

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他的动态

发布了文章 2022-3-30 14:12

如何使用API定义一个向量呢

数据类型是我们使用C++编程时必须明确的一项内容。针对AI Engine，这一点尤为重要。因为不同的数据类型所支持的运算是不同的。...

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发布了文章 2022-3-15 17:20

如何评估graph的性能

评估graph的性能对于kernel接口设计有着非常重要的意义。我们仍以前一篇文章中提到的工程为例。有三种方法可以评估graph的性能。...

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发布了文章 2022-3-15 15:30

使用Trace View对对Kernel进行性能仿真分析

对Kernel进行性能分析需要对其进行仿真，同时还要用到Vitis Analyzer。为便于说明，我们以一个简单的Vitis工程为例。这个工程中有两个kernel，相应的代码如下图所示。 kernel 1有一个输入两个输出。输入使用wi...

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发布了文章 2022-3-9 15:47

AI Engine架构的构成及应用优势

至此，我们可以看到AI Engine有三种数据源：存储单元、AXI4-Stream和级联接口。因此，编程时需要充分了解AIE的数据访问能力：2个32位AXI4-Stream输入，2个32位AXI4-Stream输出，1个384位级联Stre...

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发布了文章 2021-12-7 16:17

在Vivado中怎么定制Strategy

Vivado提供了多种Synthesis策略和Implementation策略，用户可以直接使用这些策略。尤其是希望通过扫描策略的方式实现时序收敛时，直接使用这些预定义的策略会很方便快捷。本质上，策略之间的差异是一些选项的不同造成的。以Im...

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发布了文章 2021-11-18 16:17

在Vivado中怎么定制Strategy

Vivado提供了多种Synthesis策略和Implementation策略，用户可以直接使用这些策略。尤其是希望通过扫描策略的方式实现时序收敛时，直接使用这些预定义的策略会很方便快捷。本质上，策略之间的差异是一些选项的不同造成的。以Im...

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发布了文章 2021-11-9 09:43

Vivado BDC (Block Design Container)怎么用

谈到BDC（Block DesignContainer）就不得不提IPI（IP Integrator）。IPI常被翻译为“IP集成器”，也是有道理的。它提供了一种“图形化+模块化”的设计方式。若用过Simulink或者System Gene...

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发布了文章 2021-10-30 10:33

如何利用SystemVerilog仿真生成随机数

采用SystemVerilog进行仿真则更容易生成随机数，而且对随机数具有更强的可控性。对于随机变量，在SystemVerilog中可通过rand或randc加数据类型的方式定义。rand表明该变量为随机变量，且在指定范围内服从均匀分布；r...

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发布了文章 2021-9-12 15:15

使用Vivado License Manager时Vivado的错误信息

Vivado License Manager在使用Vivado License Manager时，如果通过如下图所示方式指定license的路径时，要保证路径仅包含ASCII字符而没有中文字符。 Vivado Synthesis Hangs...

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发布了文章 2021-9-2 15:09

使用带HBM芯片有哪些要注意的地方

Virtex UltraScale+部分芯片中集成了HBM（High Bandwidth Memory）。HBM的容量最小为8GB，最大可达16GB，极大地增强了存储带宽。先从芯片结构角度看，对比VU13P和VU37P，把VU13P的SL...

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发布了文章 2021-7-6 17:22

基于Vivado下怎么找到关键路径？

什么是关键路径？关键路径分为两类：一类是时序违例的路径，主要是建立时间违例；另一类是时序没有违例，但逻辑级数较高的路径。当然，第一类路径中可能会包含第二类路径。对于第一类路径，其违例的原因无外乎逻辑延迟太大、线延迟太大或者时钟Skew...

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发布了文章 2021-6-23 15:06

看看Python中元素索引有哪些特征和规律

一旦创建矩阵，如果需要获取矩阵中的某个或某些元素，就需要用到索引。这里我们先以一个一维矩阵（也就是向量）为例，看看Python中元素索引的特征和规律。向量元素为1~5，对应的索引为0~4，可见起始地址为0，这称之为正向索引。也可以从最后一个...

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发布了文章 2021-6-15 14:26

如何在Vivado下设置BITSTREAM配置信息

首先我们看一下如何在Vivado下设置BITSTREAM配置信息。这可以在综合之后进行。借助如下操作：打开综合后的设计依次点击Tools-》 Edit Device Properties 会弹出如下界面。在这个界面的左侧部分，相当于主...

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发布了文章 2021-6-11 17:37

怎样利用Python去快速创建矩阵？

Python提供了很多函数可以快速创建矩阵。...

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发布了文章 2021-5-14 09:17

UltraScale和Versal之间有哪些不同？

作为Xilinx 7nm芯片，Versal在架构上与前一代芯片UltraScale相比有诸多不同，这里我们就来看看都有哪些不同。时钟资源从时钟Buffer角度看，多了一种BUFG_FABRIC，专门用于驱动高扇出网线，从而降低了BUFG...

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