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  • 中国上海,2022 年 12 月 14 日 —— 楷登电子(美国 Cadence 公司,NASDAQ:CDNS)今日宣布,其 EDA、IP 和云计算解决方案获得了 TSMC 颁发的六项 Open Innovation P...
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  • 随着芯片工艺尺寸的缩小趋于饱和或停滞,设计师们现在专注于通过 3D-IC 异构封装,在芯片所在平面之外的三维空间中构建系统。3D-IC 异构封装结构可能包括多个芯片,它们被放置在一个通用的中介层上,或者通过芯片内部的高级...
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  • 经验证的联电 28HPC+ 解决方案非常适用于高速毫米波器件,可提供硅精确的器件模型,支持高达 110GHz 的电路设计应用,如聚睿电子的低噪音放大器设计。Cadence Virtuoso RF 解决方案结合了多个电磁(...
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  • Cadence 致力于扩大我们的 IP 产品组合,以满足客户不断变化的设计要求。客户现在可以信心满满地在 TSMC N5 工艺节点上利用 Cadence GDDR6 设计 IP 实现更高的带宽。...
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  • 在 AR/VR 领域,“从去年开始已经慢慢看到了整个产业开始加速发展的迹象”,汪晓煜展望,如果电子光学、网络通讯、人机交互技术有进一步突破,方案日益成熟,AR/VR 甚至可以成为与 PC 和手机同等市场体量的产品形态,有...
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  • 此次获奖的 Integrity 3D-IC 平台是 Cadence 于 2021 年 10 月推出的突破性产品,它是业界首款完整的高容量 3D-IC 平台,可将设计规划、物理实现和系统分析统一集成于单个管理界面中。在面向...
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  • Cadence 射频集成电路解决方案支持 Cadence 智能系统设计(Intelligent System Design)战略,助力实现系统级芯片(SoC)的卓越设计。...
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  • 上述流程会用到两个主要工具,分别是用于模块层次优化的 Tempus ECO,以及用于 SoC 层面静态时序分析的 Tempus STA。这里缺失了全芯片(或子系统)优化与签核。至于分区间功耗恢复等则只能忽略,因为实在没时...
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  • Virtuoso Layout Suite 支持现有版图在给定工艺技术上的复用,利用自定义布局和布线自动化技术,在新的工艺技术上快速重建移植后的版图。...
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  • 数字全流程提供了支持台积电 N4P 和 N3E 工艺技术的几个关键功能,包括从合成到签核工程变更单(ECO)的原生混合高度单元行优化,可实现更好的 PPA;基于标准单元行的放置;与签核有良好相关性的实施结果...
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  • 中国上海,2022 年 10 月 27 日 —— 楷登电子(美国 Cadence 公司,NASDAQ:CDNS)今日宣布,Cadence 数字和定制/模拟设计流程已获得台积电最新 N4P 和 N3E 工艺认证,支持新的设...
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  • 2022 年 10 月,第五届中国国际透平机械学术会议(CITC)在昆明古滇名城皇冠假日酒店隆重召开。...
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  • 楷登电子(美国 Cadence 公司,NASDAQ:CDNS)作为“三星先进代工厂生态系统(SAFE)”中的合作伙伴,于今日宣布扩大与 Samsung Foundry 的合作,以加速 3D-IC 设计。得益于两家企业的持...
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  • 某知名存储器(Memory)设计制造厂商,在仿真与验证的过程中发现,针对一个 60 万个晶体管的设计,Spectre X 的精度与 APS 相差 0.21% 左右,Spectre FX 的提升速度更是达到了惊人的 72 ...
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  • 利用该设计流程,客户可以针对使用三星 8nm RF 工艺技术设计的集成电路,快捷地对比电路前仿和识别设计时的电磁效应,并完成版图寄生参数提取的后仿结果。该 8nm 射频集成电路流程是三星最新推出的技术,进一步补充了其广泛...
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