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潘文明

经验：积分：358

总经理深圳明德扬科技有限公司

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发布了文章 2022-11-8 18:08

FPGA职业生涯五个层次简述

FPGA职业生涯可以怎么划分？是很多刚入门的FPGA新手们很陌生的一个话题。职业生涯这个概念是西方国家引进的，而我们对这些理论的理解还停留在按部就班的模式，西方国家对职业生涯的研究有很多现成的理论，比如基于荣格性格类型理论的MBTI性格类型...

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发布了文章 2022-11-8 17:59

fpga项目开发感言

fpga项目开发除了技术过硬之外，还需要一些合作的心态去看待项目，下面是我操刀过这么多的fpga项目外包服务的体会： 1. 要和人配合。以我们做硬件的工程师为例，测试的时候一般都需要软件的配合，一个对硬件来说无比复杂的工作，可能在软件工程...

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发布了文章 2022-10-21 10:08

Ad8488笔记:积分电荷放大器原理

在核物理和粒子物理实验中，我们必须用电子学方法收集核辐射粒子通过探测器产生的电信号，然后对其进行处理和分析。由于探测器输出信号一般都比较小，通常在探测器与放大器之间加一预放大器，也就是前置放大器。由于输出的幅度反映了输入电荷的大小，且与输入...

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发布了文章 2022-10-12 10:33

明德扬mdyFmcAd9653-ADC系列采集板说明书

mdyFmcAD9653是由明德扬科教研发的多通道、高分辨率和高采样率的ADC系列子板，该系列包括如下型号。...

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发布了文章 2022-7-25 15:37

FPGA的时序input delay约束

本文章探讨一下FPGA的时序input delay约束，本文章内容，来源于明德扬时序约束专题课视频。...

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发布了文章 2022-7-16 09:29

JESD204B调试笔记（实用版）

进行工程的功能调试时，对AD9144,AD9516进行参数配置是非常重要且必不可少的，这过程中遇到了以下问题。...

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发布了文章 2022-7-12 08:59

使用JESD204B接口的AD9144高速DA转换模块参数设定（私人总结版）

本文为明德扬原创文章，转载请注明出处！由于AD9144是高速DA转换模块，转换速率可以达到2.5G，可以满足普通的DA数据接口。为了匹配高速AD/DA转换，JESD204B接口就应运而生，在本高速DA转换工程中，AD9144的参数设定与J...

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发布了文章 2022-7-11 11:33

时序约束系列之D触发器原理和FPGA时序结构

明德扬有完整的时序约束课程与理论，接下来我们会一章一章以图文结合的形式与大家分享时序约束的知识。要掌握FPGA时序约束，了解D触发器以及FPGA运行原理是必备的前提。今天第一章，我们就从D触发器开始讲起。...

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发布了文章 2022-7-7 08:58

JESD204B时钟网络原理概述

明德扬的JESD204B采集卡项目综合上板后，可以使用上位机通过千兆网来配置AD9144和AD9516板卡，实现高速ad采集。最终可以在示波器和上位机上采集到设定频率的正弦波。本文重点介绍JESD204B时钟网络。...

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发布了文章 2022-7-5 10:16

无人机项目中4路MIPI技术解决方案

某无人机项目4路MIPI技术方案；调试助手打印出来的图像信息，图中可以显示已经正确地接收了77224帧，共运行了约1小时，丢帧为11（注意，此处丢帧是上电后同步时的丢帧，之后处于稳定运行状态。）...

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发布了文章 2022-7-4 09:21

JESD204B协议相关介绍与具体应用实例

接触过FPGA高速数据采集设计的朋友，应该会听过新术语“JESD204B”。这是一种新型的基于高速SERDES的ADC/DAC数据传输接口。随着ADC/DAC的采样速率变得越来越高，数据的吞吐量越来越大，对于500MSPS以上的ADC/DA...

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发布了文章 2022-7-2 11:43

明德扬XILINX-K7核心板7K325 410T工业级

明德扬MP5650核心板-工业级 KINTEX-7 FPGA 芯片325T/410T 相对较低的成本实现超高的性能...

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发布了文章 2022-7-2 10:56

浅谈FPGA的时序约束四大步骤

很多读者对于怎么进行约束，约束的步骤过程有哪些等，不是很清楚。明德扬根据以往项目的经验，把时序约束的步骤，概括分成四大步...

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6235次阅读

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发布了文章 2022-6-23 08:33

为何要学习FPGA 四个理由告诉你

为什么要学习FPGA？前景好？薪酬高？没有所谓的中年危机？国家政策大力扶持？为国家技术发展贡献力量？……每个人选择一门技术都有其中的理由，学习FPGA，可以是上面的任何一个理由，可以是其他理由，如果能结合个人的兴趣就最好，从明德扬对入门学习...

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3774次阅读

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发布了文章 2022-6-21 06:50

FPGA 深度开发课程

主题 1：VIVADO 开发流程和资源评估学习目标： 1、掌握 VIVADO 开发流程 2、掌握 VIVADO 的在线调试流程 3、掌握资源评估的方法学习内容： 1、开发流程：新建工程、添加代码、添加 IP 核、配置工程等。 2、...

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