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何江
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学生 电科大
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他的提问 1 他的回答 1 去回答
  • 回答了问题 2018-9-1 12:07

    modesim 仿真出现 error

    hrj20
    学生 电科大
    找到问题了，因为同时编译了verilog和VHDL的库，如果工程里只有verilog，只需要调用verilog的库altera_ver，altera_mf_ver，lpm_ver即可
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