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黄明光

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将开路漏极输出拉到低于电源电压的位置有问题吗?

我正在连接一个5V PIC18到2.5V设备。PIC18上的一些输出可以是开路漏极。我非常熟悉漏极/开路集电极输出,并使用了很多年。然而,说明书上的措辞有点麻烦。从PIC18F66K80系列说明书第173页,第11.1.3节:>>这允许外围设备与外部数字逻辑通信,工作在较高的电压电平,而不使用电平转换器……当需要开路漏极选择时,输出管脚也必须通过用户提供的外部上拉电阻器连接到更高的电压电平,最高可达5V(图11-2)。当一个数字逻辑高信号被输出时,它被拉到更高的电压电平。<<注意,每个参考值都是将引脚拉到更高的电压。我想把针拉到2.5V,这不高于PIC18(高)5V电源。一般来说,这是毫无疑问的,这工作正常,但奇怪的是,他们强调更高的电压而不是“其他”电压。这让我想知道这些特殊的排水口是否有什么不同。有人知道更多吗?曾经尝试过使用微芯片的开漏输出被拉到低于MCU自己电源的电压吗?谢谢!

回帖(14)

周润艺

2020-5-12 10:41:55
在总线上有多个设备的总线中经常使用开式排水装置。这些设备中的每一个可以具有不同的VDD电压(例如,1.8 V 2.5 V 3.3 V,5 V)。为了让总线工作,信号线必须被拉到最高Vdd(例如,5V),以便具有最高Vdd的设备能够正确地检测低信号值和高信号值。例如,如果总线仅被拉到2.5V,当信号变高时(所有开路漏极输出断开),具有5V Vdd的设备可能不会检测到总线上的2.5V为高。这就是为什么信号线必须被拉到总线上任何设备的最高Vdd(确保不超过任何附加设备的最大Vin_high规格)。
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丁亚念

2020-5-12 11:01:08
这比那个要复杂一些。对于初学者来说,管脚是“只输出”还是双向(如I2C)对于输出来说很重要,只要有一个条件,它就可以正常工作。如果高电压低于引脚指定的“输入高电压”,则输入缓冲器将半偏置,并在高状态下消耗多余功率。如果这是支持anlog的管脚,请关闭数字输入缓冲器。对于双向管脚,当它作为输入工作时,重要的是“输入高电压”特性。对于CMOS/ST输入,即0.8Vdd,所以它确实随Vdd而变化。许多PIC确实有一些TTL兼容的输入,wHIC采取高于2V的任何东西作为一个高,但在PIC18F66 K80仅适用于RC3和RC4时,在SMBus模式启用I2C。
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王玉华

2020-5-12 11:06:53
OP:你要求的任何部分都需要设置VDD&GT;2.5V?根据数据表,您可以在2.5V运行到39兆赫:对于VDD值1.8V至3V,FMAX =(VDD - 1.72)/ 0.02 MHZ.GP。
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张雷

2020-5-12 11:25:03
谢谢大家,谢谢你们的回复。注释:>>在总线上具有多个设备的总线中经常使用开放式排水设备。<<是的,有道理,我知道这一点,但是它不适用,因为“我正在将5V PIC18连接到*a*2.5V设备”,即单个设备。这将是SPI运行两个设备之间的点对点接口,而不是总线。SPI信号也是单向的,所以不需要在三态模式下运行。>>如果高压低于引脚指定的“输入高压”,那么输入缓冲器将半偏置,并在高状态下消耗多余的功率。<<这是一个很好的点。我只是简单地考虑过,但没有给予足够的重视。更多关于这一点。&你的需求的任何部分都要求你设置VDD & Gt;2.5V?是的,这是一个我们正在添加2.5V SPI组件的现有设计。整个示意图的其余部分都是5V部分,包括模拟电路,其中我们需要5V的整个动态范围(特别是PIC18的A/D需要一个完整的5V范围)。在这个新的应用中,我们也许会受到计算上的压力,所以我们希望MCU能够支持完整的64MHz(16MIPS)。仔细考虑过这一点:我相信有可能把OD输出提高到2.5V,而不会完全破坏设备。毕竟,当被拉到(5V)时,它们在两个方向上通过2.5V过渡,并活着来讲述故事。然而,ric关于过电流的(上面)点是一个很好的点——我们将PIC18的引脚保持在逻辑低和逻辑高之间的灰色区域中,将输入晶体管运行在它们的线性范围内。对于输出电路来说很好,但是与它相关的输入电路可能不是很高兴。当我们配置一个引脚作为输出时,输入电路没有物理断开,因此它将看到有效的输出电压。由于缺乏关于在这种情况下该芯片的输入电路会发生什么的具体数据,所以最好是安全的。所以我认为我们被迫对这些信号进行正式的电平移位。不是一个巨大的交易,很容易建立一个非反相电平转换器与一个N-FET和一对电阻器。我只是希望利用这些开放的排水输出节省一些组件。谢谢你的反馈,绝对有帮助!
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