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使用UART的vhdl代码出现错误和警告怎么解决?

我已尝试使用UART的vhdl代码,但我发现了综合报告中提到的错误。
实际上我想在15.83ms内收到19位并在超级终端上显示它们。
所以我尝试过这个UART编码,但是我发现了错误和警告.... plz建议......我必须做些什么来消除错误....
综合报告.docx 17 KB
GenericUART.xise 41 KB

回帖(4)

李铃华

2020-4-23 09:39:28
似乎FIFO即时问题。
FIFO模块未在您的设计中正确实例化
谢谢和RegardsBalkrishan -----------------------------------------------
---------------------------------------------请将帖子标记为
一个答案“接受为解决方案”,以防它有助于解决您的查询。如果一个帖子引导到解决方案,请给予赞誉。
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杨兰兰

2020-4-23 09:56:20
解决FIFO问题需要哪些变化......
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李铃华

2020-4-23 10:03:30
您可以分享您的设计,以便在本地运行
谢谢和RegardsBalkrishan -----------------------------------------------
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一个答案“接受为解决方案”,以防它有助于解决您的查询。如果一个帖子引导到解决方案,请给予赞誉。
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杨兰兰

2020-4-23 10:16:46
这是我的UART代码。
但是我希望在超级终端上显示19位,例如(1个开始,8个数据,8个地址和2个停止位),这些8位数据和8位地址应该相互分离,这意味着我要显示8位数据和8位
位地址分开。
我该怎么做才能达到这个效果......
GenericUART.xise 41 KB
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