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周蓓

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CPLD读取AD7986数据结果不对

小弟目前在调试使用CPLD接收AD7986数据,转换结果总是读取不对。使用的VHDL语言,速率已经降得很低了,还是读不对。请大侠指点。

回帖(2)

周蓓

2018-11-12 15:19:33
使用48MHz 的SCK时钟可以读取正确,要提速啊,最快能用多少呢???
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周伟

2018-11-12 15:37:44
引用: wutao0105 发表于 2018-11-12 16:32
使用48MHz 的SCK时钟可以读取正确,要提速啊,最快能用多少呢???

您好!
根据数据手册,SCK的最小时间为7ns,那么频率也就是最大不能超过1/7ns=142MHz.
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