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liaris
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用逻辑分析仪抓取的FPGA信号,有异常跳变,这个会是什么原因造成的呢?
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Verilog
本帖最后由 liaris 于 2017-6-30 14:41 编辑
用逻辑分析仪抓取了
FPGA
的数据,但是有随机的异常跳变,这个可能是什么原因造成的呢??
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