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本帖最后由 elecfans跑堂 于 2015-9-14 09:20 编辑
module test; reg a,b,c; wire out; `define aa a+b `define cc c+`aa begin assign out=`cc; $display("Q"); end endmodule 错误是;.v(8): near "$display": syntax error, unexpected SYSTEM_IDENtiFIER 
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2个回答
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begin
assign out=`cc; $display("Q"); end 把begin end 去掉 在assign后加initial begin end 把$display包起来试哈 |
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首先你的begin前面没有always或者initial语句，再次你的位置好像写反了，我修改了一下，你看一下
module test; reg a,b,c; wire out; `define aa a+b `define cc c+`aa assign out=`cc; initial begin $display("Q"); end endmodule |
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2015-9-14 10:19:15
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