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reg [7:0] temp;
reg [7:0] temp1; always@(posedge clk or negedge rst_n) begin if(!rst_n) temp1 <= 0; else temp1 <= Bina_img_in; if(temp1 > 124) temp <= 255; else temp <= 0; end assign Bina_img_out = temp; endmodule 请问一 上面这段代码仿真出来的波形图怎么是这样的 不是时钟上升沿才处理吗? Bina_img_in应该往后推半个周期才对啊? 而且Bina_img_out应该是同步输出才是 怎么延后了一个半周期呢??求高手告知!!!
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1个回答
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我感觉会不会是引入两个temp变量后 引起的??
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