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学习fpga一周后的总结

2014-11-5 22:39:10 6332

0 本人初学者，有用吸收，无用过滤。 FPGA的学习很漫长，我也看过很多资料，但是都是基于中层及以下。一周时间调通了AD_SDRAM_UART的数据传输，SDDRAM看的真的是头疼，只要不灰心，每天早上都会有新的理解和收获。现在在看USB通信。个人总结一下，时序很重要，最起码对我这个初学者很重要，看懂了时序就完成了一大半，我的目的是完成功能，而不是去做到资源和速度的综合优化。所以希望大家要看工作方式和程序综合着看，静下心，没有不成功的，很多大佬也都是看懂原理才开始想着用自己的语言去描述。希望前辈们如果有时间的话可以提一下关于如何快速看懂时序的建议！ 0
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liq2014 · 2014-11-5 23:15:11 沙发关于时序是很重要也是一种捷径（个人认为），但是看不透，看着看着就分清楚了，你有什么经验可以交流交流下，指点一下！

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张新华 · 2014-11-6 16:53:50 板凳 liq2014 发表于 2014-11-5 23:15 关于时序是很重要也是一种捷径（个人认为），但是看不透，看着看着就分清楚了，你有什么经验可以交流交流下 ... 我也是初学者，在看资料上的时序，如果是例程的时序，我建议要先学仿真modelsim（会写testbench）和signaltap，通过对功能仿真和时序仿真还有实时仿真去理解程序中具体是怎么跑的，modelsim我没用明白，只会调出来，稍后马上学。会仿真才具备分析的条件，然后观察信号变化，这样理解会好一些吧，我是这么做的，不知道笨不笨，没人教过我，如果有好的方法可以推荐给我。

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liq2014 · 2014-11-9 20:38:20 4^# 这个软件我也用过很好用，也很方便能看出结果！如果你配合逻辑分析仪一起学习，加上实践会更好！

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Elecfans管家 · 2014-11-21 14:12:19 5^# 支持楼主，如果楼主有任何问题欢迎发帖分享，相信会有更多的技术大牛会帮助你来一起解决的！

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489240 · 2014-11-27 22:41:23 6^# 其实，时序图就是那样哈，如果画好了，都能看懂，如果给很多人都看不明白，那说明厂商的时序图画得不好，可以打电话过去问它们的工程师或者是FAE。

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张新华 · 2014-11-28 08:48:55 7^# liq2014 发表于 2014-11-9 20:38 这个软件我也用过很好用，也很方便能看出结果！如果你配合逻辑分析仪一起学习，加上实践会更好！ ... 道友好！modelsim还没时间学！现在在弄DSP，如果有资料，或者经验可以分享一下！

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张新华 · 2014-11-28 08:50:51 8^# glace12123 发表于 2014-11-27 22:41 其实，时序图就是那样哈，如果画好了，都能看懂，如果给很多人都看不明白，那说明厂商的时序图画得不好，可 ... thanks 我在尝试着看！

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yulin135 · 2014-11-28 12:59:27 9^# 我刚接触这个，还没入门了。多发些经验让我少走些冤枉路吧

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