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很多人遇到“Duplicate Net Names的问题,今天就分享下自己的一些心得,希望有帮助到大家。 总结的教训与大家分享:说明:是在层次原理图中遇到的问题。 1.Bus,本来原理图是我从99se中导过来的,也就是把.Sch后追的文件统统的另存为.SchDoc后追的文件,折腾了半天报“Duplicate Net Names Bus Slice D[0..15]”错误,还有地址线。网上搜了一阵,还是不行,最后看我的“D:Program FilesAltium Designer Winter 09ExamplesSignal IntegrityNbp-28”下面的工程Nbp-28.prjPCB,是层次原理图,看到人家也是这么画的,并且连个Bus Entry都没有画啊,于是乎我就将自己的Bus Entry全删掉,并把总线D[0..15]改成D[15..0],按照人家的例子按部就班。编译还是不成。最后将数据总线全部删了,重画了数据总线,编译,数据总线竟然好了,莫名其妙。 2.D[0..15]与D[15..0]有区别,如果你在另外一张原理图中的数据线是8位的即D[0..7],则在生成的PCB中奶奶的竟然是8...15,而不是想要的0...7,后来又将D[15..0]改为D[0..15],哥哥的,这下生成的PCB还算老实。竟然是0...7。 3.如果地址总线写的是A[0..23],则在只需要A1,A2,A3三根地址线的地方不能写成A[1..3],即使A0不用,但在Bus处要写成A[0..3]。 贴上部分原理图供大家分享,以地址总线为例: |
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非也非也,我也遇到这样的问题,最后发现是因为我更改了原理图的内容,但层次原理图中没有更新导致。更新后就没了,总线标号可以不从0开始的
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只有小组成员才能发言,加入小组>>
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写了一个用DMA读取ADC数据的程序,记录下整个过程和一点心得
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