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在多处理器配置中,在监听控制单元(SCU)的控制下,高速缓存关联群集中最多有四个Cortex-A53处理器可用,该监听控制单元维护L1和L2数据高速缓存一致性。
Cortex-A53多处理器支持: ·最多四个Cortex-A53处理器。 ·ARMv8-A体系结构指令集的AArch32和AArch64版本。 ·多数指令对称双发布的有序流水线。 ·具有内存管理单元(MMU)的哈佛一级(L1)内存系统。 ·提供多处理器内存一致性的二级(L2)内存系统,可选地包括一个二级缓存。 ·每核全局中断控制器(GIC)。 ·iCach/DCach大小可变。 ·每个处理器一个通用的64位定时器。 ·支持AMBA 5 CHI、AMBA 4.0 AXI一致性扩展(ACE)和AXI3主端口。 ·VFP浮点。 ·霓虹灯高级SIMD。 ·加密引擎
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