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Cortex-A520内核是一款高效低功耗内核，可实现Arm®v9.2-一个架构。Arm®v9.2-A体系结构扩展了Arm®v4-A中定义的体系结构Arm®v8.7‑A之前的体系结构。
Cortex-A520核心在DSU-120 DynamIQ中实现™ 簇它连接到DynamIQ共享单元-120，其行为与L3缓存和窥探控制完全互连。这连接配置也用于具有不同类型内核的系统中，其中CortexA520内核是高效内核。 Cortex-A520内核在一个名为complex的块中实现，该块最多包含两个核心。在双核复合体中，矢量处理单元（VPU）、L2翻译Lookaside缓冲区（TLB）和L2高速缓存逻辑在核心之间共享。 下图显示了双核配置的示例。 
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