【FPGA设计实例】如何用FPGA制作音乐盒并播放音乐【原创

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本帖最后由 eehome 于 2013-1-5 10:01 编辑

【FPGA设计实例】如何用FPGA制作音乐盒并播放音乐
HDL设计设计过程被分成3个部分：

第1部分 -简单的蜂鸣声。
第2部分 -警报器
第3部分 -调谐

一个更加正式的表示看起来像这样：

振荡器的FPGA提供了一个固定的频率。FPGA分为固定频率驱动的IO。IO是通过1kΩ电阻连接到扬声器。通过改变IO频率，FPGA产生不同的声音。

第1部分 -简单的蜂鸣声。
简单的声响 FPGA可以方便地实现二进制计数器。让我们开始与一个16位计数器。
我们使用一个25MHz的时钟，“分化”使用一个16位计数器的时钟计数从0到65535（65536不同的值）。计数器切换位25000000/65536 = 381Hz的频率最高的Verilog HDL代码看起来像这样：

查看完整资料和设计源代码下载：

FPGA论坛—【FPGA设计实例】如何用FPGA制作音乐盒并播放音乐.rar (52.49 KB, 下载次数: 1292 )

小计地盘 · 2012-8-14 10:13:29

下来看看

longc51 · 2012-8-14 12:33:25

下载听一听

海牛 · 2012-8-14 13:08:55

ddddddddddddd

李冲 · 2012-8-21 16:41:20

支持下~~~

mm709394 · 2012-8-30 22:50:10

DIY真不错,顶起

2012-9-1 08:57:38

markmark

王杰 · 2012-11-1 22:18:36

{:1:}{:1:}{:1:}

h1654155800.4826 · 2012-11-2 21:58:22

2012-11-5 22:11:56

有点意思

wangchunli · 2012-11-6 08:34:37

谢分享！

王旭 · 2012-11-6 18:07:43

唐旭 · 2012-11-18 10:20:05

好东西哈

李冲 · 2012-11-18 20:07:46

支持一下、、、

xiew2010 · 2012-11-19 13:11:13

支持下

张淡水 · 2012-11-19 16:26:20

向斌 · 2012-11-19 21:07:23

陈植锋 · 2012-11-19 21:43:14

{:1:}{:1:}

luckyfa · 2012-11-19 23:16:36

我就不下了，没有学。。。。

一眼万年Mike · 2012-11-20 00:44:29

xiongchuansky · 2012-11-21 17:41:59

在学verilog HDL，正好学习了。

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