FPGA设计实例--基于FPGA的FIR滤波器

matlab

本帖最后由 eehome 于 2013-1-5 10:08 编辑

方案一：QuartusII中的IP核。但是FIR IP没有破解，放弃。
方案二：用纯硬件描述语言搭建。
基本上分为MAC(乘积累加结构)和DA(分布式结构)。

MAC中具体结构有：
直接型FIR滤波器结构。利用FIR系数对称性特点，先对相应值相加，再做乘积运算，最后累加。该进措施可以是加上流水线结构。
实例：(参考自《EDA技术与Verilog设计》王金明编著)8KHZ采样率，8Bit输入，8Bit输出，11阶低通滤波器，fL=3.4KHZ。利用matlab得到滤波器系数，采用SD编码。tips:SD(signed digit numbers有符号数字量)，通过SD编码可以降低非零元素的数量。SD编码数字值域{1,0,-1}，-1用1上面加“-”表示。
代码如下: