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PLL设计过程详解pdf

2011-12-7 16:02:02 69999

0 介绍PLL的设计过程由浅入深容易理解游客，如果您要查看本帖隐藏内容请回复 6
2011-12-7 16:02:02　　评论淘帖0 举报相关推荐 • 【PDF】LabVIEW与Matlab的联合仿真过程详解 3062 • 《LabVIEW与Matlab的联合仿真过程详解.pdf》 7991 • 设计详解.pdf 6954 • Modbus详解(全书+PDF) 8848 • PLL_IP核的调用流程详解 1279 • 详解ZYNQ启动的过程 3872 • UART通讯过程详解 3142 • TCP通信过程详解 940 • https原理过程详解 1515 • 详解AT32 BSP完善的过程 585 307 个讨论

0 haohaohaohaohaohaohaohaohao

2016-3-11 01:11:48 评论举报 141^# crazylk

0 正在找这个。。。

2016-3-28 17:35:21 评论举报 142^# alpha0721

0 谢谢楼主分享。好东西啊，看完了写一些问题

2016-4-1 08:38:42 评论举报 143^# tigergatlin

0 谢谢,看一下

2016-4-3 16:25:37 评论举报 144^# mx673837710

0 想看看，学习一下

2016-4-5 20:42:03 评论举报 145^# 1723845064

0 版图那，学习学习

2016-4-6 14:53:57 评论举报 146^# 高立稳

0 谢谢楼主的分享，非常有用啊

2016-4-28 20:16:59 评论举报 147^# swqa1123

0 这么好的资料，谢谢。

2016-5-4 10:24:45 评论举报 148^# 飞翔

0 正在学习锁相环感谢分享

2016-5-15 19:45:57 评论举报 149^# 华电B301

0 PLL(Phase Locked Loop),锁相回路或锁相环，用来统一整合时脉讯号，使内存能正确的存取资料。PLL用于振荡器中的反馈技术。许多电子设备要正常工作，通常需要外部的输入信号与内部的振荡信号同步，利用锁相环路就可以实现这个目的。

2016-5-16 10:09:49 评论举报 150^# sinap_zhj

0 锁相环的特点是：利用外部输入的参考信号控制环路内部振荡信号的频率和相位。因锁相环可以实现输出信号频率对输入信号频率的自动跟踪，所以锁相环通常用于闭环跟踪电路。锁相环在工作的过程中，当输出信号的频率与输入信号的频率相等时，输出电压与输入电压保持固定的相位差值，即输出电压与输入电压的相位被锁住，这就是锁相环名称的由来。锁相环通常由鉴相器（PD,Phase Detector）、环路滤波器（LF,Loop Filter）和压控振荡器（VCO,Voltage Controlled Oscillator）三部分组成.

2016-5-16 10:31:49 评论举报 151^# sinap_zhj

0 好想看一下，谢谢分享

2016-5-19 22:08:42 评论举报 152^# hl9788

0 谢谢喽，很想学习一下PLL相关的知识。。。。。

2016-5-20 14:33:35 评论举报 153^# zhangwenjian

0 想学习学习看看资料。

2016-5-24 16:33:50 评论举报 154^# 黄月明

0

2016-5-26 15:38:50 评论举报 155^# abby118

0 想看一看，学习一下，很需要

2016-6-9 10:56:33 评论举报 156^# nk_helili

0 先看看啊先看看啊先看看啊

2016-6-21 15:04:22 评论举报 157^# Illumination1

0 看一下，支持一下，内容如何

2016-6-23 16:43:10 评论举报 158^# 515369

0 ddddddddddddd

2016-7-19 10:42:30 评论举报 159^# zx2013

0 目前在做锁相环

2016-8-4 13:06:59 评论举报 160^# nkwf

只有小组成员才能发言，加入小组>>

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