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 列驱动电路由集成电路74HC595构成，它具有一个8位串入并出的移位寄存器和一个8位输出锁存器的结构，而且移位寄存器和输出锁存器的控制是各自独立的，可以实现在显示本行各列数据的同时，传送下一行的列数据，即达到重叠处理的目的。 74HC595的外形及内部结构如图7.3所示。它的输入侧有8个串行移位寄存器，每个移位寄存器的输出都连接一个输出锁存器。引脚SI是串行数据的输入端。引脚SCK是移位寄存器的移位时钟脉冲，在其上升沿发生移位，并将SI的下一个数据打入最低位。移位后的各位信号出现在各移位寄存器的输出端，也就是输出锁存器的输入端。RCK是输出锁存器的打入信号，其上升沿将移位寄存器的输出打入到输出锁存器。引脚G是输出三态门的开放信号，只有当其为低时锁存器的输出才开放，否则为高阻态。SCLR信号是移位寄存器的清零输入端，当其为低时移位寄存器的输出全部为零。由于SCK和RCK两个信号是互相独立的，所以能够做到输入串行移位与输出锁存互不干扰。芯片的输出端为QA～QH，最高位QH可作为多片74HC595级联应用时，向上一级的级联输出。但因QH受输出锁存器打入控制，所以还从输出锁存器前引出了QH’，作为与移位寄存器完全同步的级联输出。 图7.3 74HC595外形及内部逻辑结构图 7.3.3行驱动电路 单片机P1口低4位输出的行号经4/16线译码器74LS154译码后生成16条行选通信号线，再经过驱动器驱动 |
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