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各位朋友:
最近再调AD9361 在接收这部分卡了很久了,不知道怎么解决 ,希望各位帮帮忙 。我来说一下我的问题 AD9361 使用S6系列FPGA配置的 工作在FDD,Slow Attack AGC DATA_CLK 20M模式下 。在接收时,即使没加信号,AD采出来的数通过chipscope抓出来看 仍然有 而且很大。加了信号之后的 波形也不正常 ,之后用bist测试 证明数据接口部分没有问题 。图片请看附件。 |
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2个回答
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您好,我想问下用bist测试怎么用的?
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