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您好:
数字下变频芯片AD6620的使用手册第18页的figure28,注意其中的的CLK以及tDPR和tDPF,这个CLK是进入DDC时的数据采样时钟吗?如果是的话,那这个CLK是很大的值,意思是说DDC最终出来的的数据速率和进入DDC的速率是一样的,那这不是没有起到降低数据率的目的了吗? 这个CLK到底是个什么样的CLK呢?谢谢!!! 祝顺利!! |
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1个回答
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您好!
CLK为AD6620提供系统时钟。降低输出信号速率是通过CIC滤波器完成的。 还有AD6620是比较老的产品,已不推荐在新设计中使用。新产品您可以考虑使用AD6649。 |
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