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按照书上的分频电路，综合后仿真出来是未知值？

2017-9-2 12:54:41 2717

0 前仿真没问题，但是综合之后，输出的时钟就是未知量，一条红线？ -- clk_div.vhd LIBRARY IEEE; USE IEEE.Std_Logic_1164.ALL; USE IEEE.Std_Logic_Arith.ALL; USE IEEE.Std_Logic_Unsigned.ALL; ENtiTY clk_div IS PORT (clkin :IN Std_Logic; reset: in STD_Logic; clkout :OUT Std_Logic ); end; ARCHITECTURE BEHAVIR OF clk_div IS signal temp:std_logic; signal count :Integer RANGE 0 TO 3; begin process(clkin，reset) begin if reset='0' then temp<='0'; elsif falling_edge(clkin) then if count=3 then count<=0; temp<=not temp; else count<=count+1; end if; end if; end process; clkout<=temp; end; 0
2017-9-2 12:54:41　　评论淘帖0 举报相关推荐 • 分频电路设计和仿真 2777 • 功能仿真、综合后仿真与时序仿真 5505 • 为什么Multisim仿真，按照书上电路图连接，没输出波形？ 18803 • 请问按照何乐年书上的电路参数做仿真差距很大的原因是什么？ 1045 • TINA按照这个图形仿真反相放大电路，但是仿真出来的波形不对，为什么？ 135 • ISE联合modelsim功能仿真和综合后仿真 5384 • STM32 USART的配置完全按照书上的写的，但是仿真就是看不到波形是为什么？ 116 • 什么是分频电路？如何分频呢？ 4191 • python怎么把for循环的值拿出来 3435 • 为什么按照朱兆祺书上改的UBOOT无法使用？ 3907