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`SEGGER J-Link Commander V4.98c ('?' for help) Compiled Apr 23 2015 20:22:10 DLL version V4.98c, compiled Apr 23 2015 20:21:50 Firmware: J-Link V9 compiled Apr 21 2017 11:08:06 Hardware: V9.40 S/N: 59410329 Feature(s): RDI, GDB, FlashDL, FlashBP, JFlash VTarget = 1.811V Info: TotalIRLen = 12, IRPrint = 0x0011 Info: ARM AP[0]: 0x64770001, AHB-AP Info: ARM AP[1]: 0x44770002, APB-AP Info: ROMTbl 0 [0]: 00040003, CID: B105100D, PID:00-00080000 ROM Table Info: ROMTbl 1 [0]: 00010003, CID: B105900D, PID:04-002BB908 CSTF Info: ROMTbl 1 [1]: 00020003, CID: B105100D, PID:04-000BB4A7 ROM Table Info: ROMTbl 2 [0]: 00010003, CID: B105900D, PID:04-005BBC07 Cortex-A7 Info: Found Cortex-A7 r0p5 Info: 6 code breakpoints, 4 data breakpoints Info: Debug architecture ARMv7.1 Info: Data endian: little Info: Main ID register: 0x410FC075 Info: I-Cache L1: 32 KB, 512 Sets, 32 Bytes/Line, 2-Way Info: D-Cache L1: 32 KB, 128 Sets, 64 Bytes/Line, 4-Way Info: Unified-Cache L2: 512 KB, 1024 Sets, 64 Bytes/Line, 8-Way Info: System control register: Info: Instruction endian: little Info: Level-1 instruction cache disabled Info: Level-1 data cache disabled Info: MMU disabled Info: Branch prediction enabled Found 2 JTAG devices, Total IRLen = 12: #0 Id: 0x5BA00477, IRLen: 04, IRPrint: 0x1, CoreSight JTAG-DP (ARM) #1 Id: 0x16B0001D, IRLen: 05, IRPrint: 0x1, PowerPC JTAGC-TAP Cortex-A7 identified. Target interface speed: 100 kHz J-Link> 调试飞思卡尔的CPU, JTAG可以发现内核但是连接的时候总是失败,请教大神这是什么原因,上电和复位以及是时钟信息测量都没问问题。谢谢! `
以太网线性保护倒换技术要求.pdf
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1个回答
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……你试试改个芯片的型号,从新编译一下看看,我感觉像是用了错的兼容型芯片代码编译的,不像是用的专用型号的OS代码编译的。
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