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转发一个verilog的教程，极简，附带源码和完整仿真环境，可以一起学习

2018-4-4 08:40:10 4216 PCA模块计数器 Verilog

0 Verilog是拿来用的，不是用来学的。这是Verilog的一份极简教程，涵盖日常设计中的绝大部分基本语法。语法不重要。关键是实践。完整的代码和仿真环境在github共享。 https ic7x24 dot com 教程说明运行环境 RTL: 模块声明与例化(Module) RTL: 常数 RTL: 变量(wire, reg) RTL: 运算符 RTL: 函数(function) RTL: 存储器(SRAM) RTL: 存储器(ROMM) TB : 仿真精度(timescale) TB : 任务(task) TB : 时钟与复位产生(clock_reset_gen) TB : 波形文件产生(wave_dump) TB : 存储器初始化(mem_init) RUN : Makefile RUN : Questasim(sim.do) 2
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6个人 · 2018-4-4 22:15:56 沙发大叔大婶大所大多大所大多多大大所多

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袁媛 · 2018-4-16 09:20:57 板凳大佬，github是啥呀

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张杰 · 2018-4-17 22:27:07 4^# 一起学习一起学习一起学习一起学习一起学习一起学习一起学习一起学习一起学习一起学习

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石顏彰 · 2018-4-18 09:29:45 5^# 十分感谢！前几天还想买这本书呢，没想到有电子版！开心

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张三 · 2018-4-19 13:02:59 6^# github地址欢迎围观。github.com/ic7x24/verilog-mini-demo

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lvhf · 2018-4-24 09:07:48 7^# 十分感谢！前几天还想买这本书呢，没想到有电子版

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59157151 · 2018-5-22 11:02:51 8^# 现状XZXZX啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊

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59157151 · 2018-5-22 11:03:18 9^# 现状XZXZX啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊啊

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韩裔 · 2018-5-23 10:24:26 10^# 一起学习学习学习，谢谢谢谢谢谢系诶谢谢系诶

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yybush1 · 2019-2-6 11:28:25 11^# 谢谢楼主，辛苦了

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