HNSY002358的专栏_电子工程师 - 电子技术论坛

HNSY002358

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Vivado与ISE同时运行出现的奇怪现象
2023-12-4 09:54

近几天调试开发板，主芯片是XC7A100T，用Vivado给开发板下载bit文件，正常工作。...

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MMCU/PLL时钟约束导致的问题调试笔记
2023-10-7 14:35

调用MMCU产生时钟，输入时钟频率为100M，产生100M、50M、12.5M时钟输出，MMCU核自动生成的时钟倍频数为9，即主时钟为900M，分别分频9得100M，18得50M，72得12.5M。...

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FSK调制解调方法简析
2023-3-31 09:07

FSK通信系统主要由基带数据生成模块（pcm.v)、FSK调制模块（fsk_mod.v) 、FSK解调模块（fsk_demod.v）和锁相环位同步模块（BitSync.v）组成。...

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DPSK调制解调实验心得
2023-3-30 09:26

DPSK调制解调电路程序主要由基带信号生成模块（pcm.v)、绝对码转相对码模块（Coder.v）、Psk调制模块（psk_mod.v)、Costas模块（Costas.v）、位同步模块（BitSync.v）和相对码转绝...

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DPSK调制解调方案
2023-3-29 09:11

基带信号生成模块（pcm.v)产生码率为390.625kbps的基带数据，送给Coder.v完成相对码的转换，同时将绝对码送CXD301扩展口观测。转换后的相对码送给PSK调制模块；...

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PSK调制解调知识简析
2023-3-28 09:23

基带信号生成模块（pcm.v)产生码率为390.625kbps的基带数据，送给CRD500扩展口观测的同时，送给PSK调制模块；...

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信号发生器电路简析
2023-3-6 15:48

信号发生器电路程序主要串口通信模块（uart.v)、方波模块（square.v)、锯齿波模块（sawtooth.v）、三角波模块（triangle.v）、基带数据模块（pcm.v）和调制模块（modulate.v）组成。...

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插值法帧同步解析
2023-3-6 15:40

同步方式：具有搜索、校验、同步三种状态：帧长、帧同步字、搜索容错位数、校核容错位数、同步容错位数可通过修改程序参数快速设置。...

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一文详解锁相环位同步
2023-3-6 15:37

基带数据生成模块生成的原始数据（1.5625Mbps）送至开发板上扩展口的第9脚，经短接线由第10脚送回FPGA芯片；...

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一文简析插值法帧同步
2023-2-10 14:00

同步方式：具有搜索、校验、同步三种状态：帧长、帧同步字、搜索容错位数、校核容错位数、同步容错位数可通过修改程序参数快速设置。...

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插值法帧同步（ISE/Verilog/CXD301）
2023-2-8 11:50

基带数据生成模块生成的原始数据（1.5625Mbps）送至开发板上扩展口，经短接线由第35脚送回FPGA芯片；数据生成的同步时钟信号也经扩展口硬件环回至帧同步模块。为便于测试环路同步及失步状态，输入端设计了一个数据选择控...

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插值法帧同步ISE/Verilog/CXD301介绍
2023-2-8 11:48

同步方式：具有搜索、校验、同步三种状态：帧长、帧同步字、搜索容错位数、校核容错位数、同步容错位数可通过修改程序参数快速设置。...

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呼吸灯电路设计
2023-1-29 11:01

呼吸灯电路设计...

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信号发生器电路（Quartus/Verilog/CRD500）
2023-1-29 10:16

方波模块（square.v)、锯齿波模块（sawtooth.v）、三角波模块（triangle.v）分别根据指令参数产生方波、锯齿波和三角波信号。基带数据模块产生8比特循环的基带数据11111010，并将基带数据送至调制...

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计数器才是流水灯的核心
2023-1-3 10:48

计数器才是流水灯的核心...

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