sanyue7758的专栏_电子工程师 - 电子技术论坛

sanyue7758

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VCS+VERDI的reverse反向运行功能
2023-4-12 10:11

假设一种场景，在调试环境的时候，运行到15min的时候，环境出现bug，需要去debug。也许错误的第一现场并不是15min的时候，可能在14min30s-15min之间，那么如果正向执行就需要14min30s以上。...

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浅谈中断验证
2023-4-11 09:51

中断是指：芯片在执行程序指令流的过程中，突然出现某些意外情况而需要中止执行当前程序，并转入处理新的程序指令流，处理完毕后又返回原被暂停的程序指令流继续运行的机制。...

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科普一下工程项目中常常碰到的中断验证
2023-4-11 09:52

在工程项目中，不管是小到模块级验证，还是大到系统级验证，都有一项不可缺少的feature，那就是中断。...

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CRC校验verilog代码如何生成？
2023-4-11 09:28

CRC码存储或传送后，在接收方进行校验过程，以判断数据是否有错，若有错则进行纠错。一个CRC码一定能被生成多项式整除，所以在接收方对码字用同样的生成多项式相除，如果余数为0，则码字没有错误；...

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看看使用芯片验证随机带来的六宗罪
2023-4-10 11:21

以前看到不少验证技术书籍都在说验证环境中随机怎么怎么好，然后为了随机，UVM,SV 提供了什么什么支持。...

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SystemVerilog/Verilog中的各种延迟模型
2023-4-9 10:26

如果信号从0/1/z变化到x,那么此时的门传输延迟为上述三种延迟最小的.另外,在进行仿真时,有些逻辑门的输出不可能会出现高阻态z,所以对于这些逻辑门实际上就不存在关断延迟了,类似的逻辑门有：and、nand、or、nor...

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谈谈Formal验证中的Equivalence Checking
2023-4-8 09:22

Lec形式验证想必ICer们都很熟悉，尤其是中后端的IC工程师，在正常逻辑综合生成网表过后或DFT插入mbist等可测试逻辑综合后，需要对综合后产生的网表与综合前的RTL代码进行等效逻辑Lec验证，目的是为了保证综合过程...

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温度反转效应它到底为什么会发生呢？
2023-4-7 09:37

在做STA Signoff时，对于Setup来说选择Slow Corner，也就是慢工艺（SS）、低压（Low Voltage）、高温（High Temperature）；...

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CPU是怎么实现加速的？
2023-4-6 10:58

软件在CPU上执行，采用一定的流水线执行指令，通常有取指（Instruction Fetch）、译码（Instruction Decode）、执行（Execute）、访存（Memory）、写回（Write Back）这几...

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IC设计中的多时钟域处理方法总结
2023-4-6 10:56

我们在ASIC或FPGA系统设计中，常常会遇到需要在多个时钟域下交互传输的问题，时序问题也随着系统越复杂而变得更为严重。...

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盘点UVM不同机制的调试功能
2023-4-6 09:36

基于UVM搭建验证环境和构造验证激励，调试的工作总是绕不开的。实际上，对验证环境和激励的调试，往往伴随着验证阶段的前半程，并且会花掉验证工程师很多时间和精力。...

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介绍调试Debug过程中常用的方法和技巧
2023-4-4 10:42

调试应该说是任何一个工程师解决问题的必备技能，对于芯片验证工程师来说更是如此。...

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芯片功耗的IR分析
2023-4-4 09:46

低功耗设计的重要性，从下图可窥一斑，随着工艺节点的推进演化，45nm工艺的动态功耗、静态功耗相比90nm工艺分别增加到了2倍、6.5倍。...

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RTL顶层自动连线的秘密武器：Emacs verilog-mode介绍
2023-4-3 10:48

Verilog-mode.el 是用于 Emacs 的非常流行的免费 Verilog 模式，它提供上下文相关的突出显示、自动缩进，并提供宏扩展功能以大大减少 Verilog 编码时间。...

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手把手教你学习Spyglass工具
2023-4-3 10:46

作为IC设计人员，熟练掌握数字前端语法检查工具Spyglass的重要性不言而喻，本文手把手教你学习Spyglass工具。...

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