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手里的萨尔玛特不香了

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北京市朝阳区丨设计开发工程

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基于FPGA的SRIO协议设计 2023-09-04 18:19

本文介绍一个FPGA常用模块：SRIO（Serial RapidIO）。SRIO协议是一种高速串行通信协议，在我参与的项目中主要是用于FPGA和DSP之间的高速通信。有关SRIO协议的详细介绍网上有很多，本文主要简单介绍一下SRIO IP核的使用和本工程的源代码结构。

Baekhyn0506

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如何在Vivado中配置FIFO IP核 2023-08-07 15:36

Vivado IP核提供了强大的FIFO生成器，可以通过图形化配置快速生成FIFO IP核。

Baekhyn0506

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学习FPGA新IP核的正确打开方式 2023-08-07 15:43

FPGA开发过程中，利用各种IP核，可以快速完成功能开发，不需要花费大量时间重复造轮子。

Baekhyn0506

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浅谈FPGA输入时钟要求 LVDS与LVPECL讲解 2023-08-21 11:28

几年前FPGA时钟只需要连接一个单端输入的晶振，非常容易。现在不同了，差分时钟输入，差分信号又分为LVDS和LVPECL，时钟芯片输出后还要经过直流或交流耦合才能接入FPGA，有点晕了，今天仔细研究一下。

Baekhyn0506

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FPGA学习笔记：PLL IP核的使用方法 2023-08-22 15:04

IP（Intellectual Property）是知识产权的意思，半导体行业的IP是“用于ASIC或FPGA中的预先设计好的电路功能模块”。一些常用的复杂的功能模块（如FIFO、RAM、FIR滤波器、SDRAM控制器、PCIE接口等），不可能每次使用都要用户自行设计，所以可以将其设计成参数可修改的模块，其他用户可以直接调用。具有复杂功能和商业价值的IP核一般具有知识产权。

Baekhyn0506

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基于FPGA的PCIE通信测试 2023-09-04 16:45

本文介绍一个FPGA开源项目：PCIE通信。该工程围绕Vivado软件中提供的PCIE通信IP核XDMA IP建立。Xilinx提供了XDMA的开源驱动程序，可在Windows系统或者Linux系统下使用，因此采用XDMA IP进行PCIE通信是比较简单直接的。

Baekhyn0506

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FPGA的BRAM资源使用优化策略 2023-08-30 16:12

FPGA的BRAM和LUT等资源都是有限的，在FPGA开发过程中，可能经常遇到BRAM或者LUT资源不够用的情况。

Baekhyn0506

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FPGA学习笔记：RAM IP核的使用方法 2023-08-29 16:46

我们知道除了只读存储器外还有随机存取存储器，这一篇将介绍另一种存储类IP核 ——RAM的使用方法。RAM是随机存取存储器（Random Access Memory），是一个易失性存储器，断电丢失。RAM工作时可以随时从任何一个指定的地址写入或读出数据。

Baekhyn0506

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FPGA RAM简介和使用案例 2023-08-22 16:12

在FPGA 逻辑设计中经常用到的数据存储方式有ROM、RAM和FIFO,根据不同的应用场景选择不同的存储方式。Xilinx 平台三种存储方式在使用过程中的区别如下。

Baekhyn0506

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Vivado中BRAM IP的配置方式和使用技巧 2023-08-29 16:41

FPGA开发中使用频率非常高的两个IP就是FIFO和BRAM，上一篇文章中已经详细介绍了Vivado FIFO IP，今天我们来聊一聊BRAM IP。

Baekhyn0506

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