07q4_赛灵思的专栏_电子工程师 - 电子技术论坛

07q4_赛灵思

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Zynq SoC 给赛灵思带来的收益
2019-7-24 16:25

现在让我们看一下平台电子产品巨头公司采取哪些措施来提高其盈利能力；Zynq SoC为何远优于ASIC、单独的ASSP甚至是ASSP+FPGA双芯片平台实现方案；以及您如何顺利利用Zynq SoC迅速提高自己公司的盈利能力...

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FPGA为科学家探索宇宙大爆炸提供帮助
2019-7-24 16:31

二十世纪四十年代发现了超导体电热平衡性及其测量入射电磁能量的功能，但是TES探测器直到二十世纪九十年代才得到广泛应用。...

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设计可靠性--产品设计的开始
2019-7-24 16:40

上述结果可以通过通信链路以健康状态的形式进行传送，保存在非易失性存储器之中，例如，flash或FRAM或二者同时使用。...

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Tcl在Vivado中的基础应用及优势
2019-7-24 16:52

实际上Tcl的功能可以很强大，用其编写的程序也可以很复杂，但要在Vivado或大部分其它EDA工具中使用，则只需掌握其中最基本的几个部分...

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Vivado 设计套件使用方法和注意事项
2019-8-1 08:47

想到要写这一系列关于工具和方法学的小文章是在半年多前，那时候Vivado已经推出两年，陆陆续续也接触了不少客户和他们的设计。我所在的部门叫做“Tools & Methodology Applications”，其实也是专...

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Vivado使用教学设计技巧
2019-7-24 17:10

其中，-include_generated_clocks 表示所有衍生钟自动跟其主时钟一组，从而与其它组的时钟之间为异步关系。不加这个选项则仅仅将时钟关系的约束应用在主时钟层面。...

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CDC设计和约束技巧
2019-7-24 17:19

建议的做法是：首先，对“Common Primary Clock”排序（显示为Yes 或No），这么做可以快速鉴别出那些安全和不安全的CDC路径，接着观察对应的“Inter-Clock Constraints”栏内的内容...

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赛灵思宣布推出新的开发环境，将数据中心的单位功耗性能提高达25倍
2019-8-1 08:45

All Programmable 技术和器件的全球领先企业赛灵思公司（Xilinx, Inc. (NASDAQ:XLNX)）在国际超算大会（Super Computing 2014）上宣布推出针对OpenCL、C和C++...

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用Tcl定制Vivado设计流程详解
2019-7-24 17:30

工程模式的关键优势在于可以通过在Vivado 中创建工程的方式管理整个设计流程，包括工程文件的位置、阶段性关键报告的生成、重要数据的输出和存储等。...

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赛灵思公司和恩智浦半导体公司宣布，将降低资本支出和运营支出成本
2019-8-1 08:59

高效功率放大器实现了同样出色的无线电输出功率，而且通过使用额定功率较低的设备以及减少冷却机械装置数量，还能够节省资本支出。赛灵思的Zynq-7000 All Programmable SoC是业界首款支持最新一代CPRI...

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赛灵思视角下的未来
2019-7-24 17:40

如果还按照筛选，我要在1ms内把一大堆数据放到一起筛选，一个方法就是在它的所谓的控制器里再加上过滤逻辑，这样，我读写数据的时候，就可以把我的智能放进去，在网络上用传统的数据就可以实现你的功能。...

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赛灵思系列芯片支持Convey Computer公司的硬件加速器板卡
2019-7-24 17:49

以前加速器应用设计主要使用硬件描述语言（HDL）例如Verilog来进行程序设计。这就需要专门的技能和工具软件，这就限制了这个器件不能被更多的人所接触到。...

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赛灵思在CSIA-ICCAD上演讲
2019-7-24 09:57

根据“集成电路产业“十二五”发展规划”，集成电路（IC）产业是国民经济和社会发展的战略性、基础性和先导性产业，是培育发展战略性新兴产业、推动信息化和工业化深度融合的核心与基础。拥有强大的集成电路技术和产业，是迈向创新型国...

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赛灵思的目标和发展
2019-7-24 17:58

赛灵思公司亚太区销售与市场副总裁杨飞表示，赛灵思的SDx系列仍会持续发展。毫无疑问，这会帮助赛灵思面向更为广泛的用户群。事实上，不仅是数据中心，未来，有线通信、无线通信等领域都有广阔的应用前景。...

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设计建模系统流量并验证系统的性能
2019-7-25 08:38

如果您要进行这种类型的分析，AXI流量生成器正是您需要的那种仪器。在您的团队将系统硬件设计到Zynq SoC PL中之前，这些流量生成器可以作为系统硬件流量生成的代理。...

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