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  • 数字延迟线工作原理及如何设计 2018-10-08 08:40
    随着EDA技术的广泛应用，CPLD已成为现代数字系统设计的主要手段， CPLD的时钟延迟可达到ns级，结合其并行工作方式，在超高速、实时测控方面有非常广阔的应用前景；并且CPLD具有高集成度、高可靠性，几乎可将整个设计系统下载于同一芯片中，实现所谓片上系统，从而大大缩小其体积。
    电子设计
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