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上海市浦东新区丨设计开发工程

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CTS的前世今生

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ClockTree Synthesis，时钟树综合，简称CTS。时钟树综合就是建立一个时钟网络，使时钟信号能够传递到各个时序器件。CTS是布局之后相当重要的一个步骤，在现如今集成了上亿个晶体管的芯片上，如何设计一个合理的时钟 ...

来源：FPGA|CPLD|ASIC论坛
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全面介绍充满魔性的Placement

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相信每个数字后端PR工程师都知道Placement。它是我们设计芯片的两大目的之一——布局布线（Place&Route）。这也是最体现EDA工具的实力强大之处。可能大家平时只是简单的运行一个命令，但是对工具来说，要把几千万个 ...

来源：FPGA|CPLD|ASIC论坛
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用python编写一个高效搜索代码工具

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用python编写一个高效搜索代码工具大多码农在linux环境下使用grep+关键词的命令搜索自己想要的代码或者log文件。今天介绍用python如何编写一个更强大的搜索工具，windows下也适用。我们的需求：1，可以同时指定多个 ...

来源：上位机软件（C/Python/Java等）
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IC攻城狮求职宝典 06 比特大陆笔试题

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请对面向对象编程中多态性（polymorphism）的概念以及多态性对代码可重用的意义进行阐述。解析：在面向对象编程中一般是这样表述多态性：向不同的对象发送同一条消息（！！！obj.func():是调用了obj的方法func，又称 ...

来源：招聘|求职发布区
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IC攻城狮求职宝典 07 cadence笔试题

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IC设计 Cadence 2018设计笔试题Choice Questions1. What is theminimum number of flip flops to implement a state machines to detect the bitsequence 11011001? & ...

来源：FPGA|CPLD|ASIC论坛
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求职宝典：寒武纪2019笔试题

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IC攻城狮求职宝典 03 2018年IC设计企业寒武纪 1请简述：定宽数组，动态数组，关联数组，队列四种数据类型的各自特点。解析：（1）定宽数组：其宽度在声明的时候就指定了，故其宽度在编译时就确定了。（2）动态数组 ...

来源：FPGA|CPLD|ASIC论坛
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IC攻城狮求职宝典05钜泉光电笔试题

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IC攻城狮求职宝典05钜泉光电笔试题 1. 同步电路(synchronous circuits)和异步电路(asynchronous circuits)的区别？解析：同步电路的时钟源是一个，包括通过PLL分频和倍频的时钟，都可以认为是同步时 ...

来源：FPGA|CPLD|ASIC论坛
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IC攻城狮求职宝典08-地平线

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地平线2019届技术招聘笔试题1：在当前深度学习领域应用场景下，请比较ASIC,GPU,FPGA,CPU,DSP的各自优缺点。 ASIC: Application Specific IntegratedCircuit专用集成电路。是指应特定用户要求和特定电子系统的需要而 ...

来源：FPGA|CPLD|ASIC论坛
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EKW模拟版图面试题答案

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技术类问题l 通用问题1. MOS（metal oxidesemiconductor金属氧化物半导体），按制程可以分为哪几种？笔试题• Pmos:在MOS制程技术中是最简单，所以被 ...

来源：FPGA|CPLD|ASIC论坛
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2018年IC设计企业笔试题01英伟达Nvidia

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笔试真题： 1、什么是建立时间、保持时间，如果setup time violation或者hold time violation 应该怎么做？（10分）答案：建立时间：是指在触发器的时钟信号采样边沿到来之前，数据保持稳定不变的时间 ...

来源：FPGA|CPLD|ASIC论坛