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薛如军

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硬件工程师泰瑞达（上海）有限公司

安徽省合肥市丨设计开发工程

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基于ZU+的外挂8颗DDR4的设计案例分析 2020-12-21 14:04

本篇主要针对Zynq UltraScale + MPSoC的DDR接口，从硬件设计的角度进行详细介绍，最后展示一下小编之前自己设计的基于ZU+的外挂8颗DDR4的设计。目前比较常用的DDR是DDR4和DDR3，其他系列相对使用较少一些，本文主要以DDR4进行介绍。 1、选型根据ZU+系列芯片的数据手册、TRM、pg150等文档，DDR可以挂载在PS侧，也可以挂载在PL侧，也可同时挂载在PS侧和PL侧。 PL和PS均支持64位的DDR4（不带ECC功能），PL部分如果要支持64位的DDR4，则至少需要提供三个bank的HP接口，只能

电子设计

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