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广东省 深圳市 丨 设计开发工程
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  • 发布了文章 2022-2-8 14:29

    高性能数据中心的网络演进趋势
    随着云计算的兴起，越来越多的计算被部署到云端来执行，数据中心的运营模式逐渐云化，从接入模式来看，当前部署的云计算主要分为公有云、私有云和混合云。私有云主要是单位或者个人使用的云计算资源，不对外提供，因此可以不兼容传统以太网，在诸如高性能的分...
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  • 发布了文章 2022-2-8 14:27

    PYNQ框架下开发可重构运动控制器
    这项工作是由加州州立理工大学波莫纳分校、C3SR的产学合作课程设计项目。该项目的目标是创建一个通用的运动控制器，与任何运动控制系统或设备兼容，解决工业和开源运动控制器中的问题，同时也相对便宜，易于对创作者群体进行扩展。...
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  • 发布了文章 2022-2-8 14:23

    BSCANE2模块是FPGA中的一个特殊硬核模块
    在 FPGA 中，JTAG 管脚除了负责原始的芯片测试功能 (IEEE1149.1)，还主要用于下载和调试，比如ILA就是通过 JTAG 接口捕捉内部逻辑信号，送回 ISE 或 Vivado，并在界面上直接显示和控制。BSCANE2 其实就...
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  • 发布了文章 2022-2-8 14:19

    Zynq UltraScale+ 器件与PL DNA不同的值
    Xilinx 用两个 96 位独特器件标识符（称为器件 DNA）为每个 Zynq UltraScale+ 器件编程。一个 DNA 值位于可编程逻辑 (PL) 中，另一个 DNA 值位于处理系统 (PS) 中。这两个 DNA 值是不同的，但每...
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  • 发布了文章 2022-2-8 14:13

    Xilinx_A7_K7_V7系列Cadence符号库
    Xilinx_A7_K7_V7系列Cadence符号库及PCB库，包含的型号有XC7A100T-1FGG484I；XC7A200T-1FBG676I；XC7K325T-2FFG900I；XC7K410T-2FFG900I；XC7VX690T...
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    2858次阅读
    1条评论
  • 发布了文章 2022-2-8 14:10

    vivado2017.4生成比特流失败报错信息
    使用Vivado Runs基础结构时（例如，launch_runs Tcl命令），请将此命令添加到.tcl文件，并将该文件作为执行运行的write_bitstream步骤的预钩添加...
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    4547次阅读
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  • 发布了文章 2022-2-8 14:01

    Xilinx原语使用方法有哪些
    Xilinx公司的原语按照功能分为10类，包括：计算组件、I/O端口组件、寄存器和锁存器、时钟组件、处理器组件、移位寄存器、配置和检测组件、RAM/ROM组件、Slice/CLB组件以及G比特收发器组件。下面分别对其进行详细介绍。...
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    1401次阅读
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  • 发布了文章 2022-2-8 11:48

    Zynq 在非 JTAG 模式下的启动配置流程
    初学 Zynq 的时候，都是按照惯例打开 Vivado 软件，然后实现 Zynq 可编程逻辑硬件部分PL的设置后，把硬件部署导出，再打开 SDK 进行 ARM 核的软件部分 PS 编程设计，最后再将硬件比特流文件（.bit）和软件的可执行链...
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    1318次阅读
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  • 发布了文章 2022-2-8 11:47

    关于FPGA千兆以太网的开发
    在开发以太网接口的过程中经常看到 MII、RMII、GMII、RGMII等英文缩写名称。在开发接口前，先将这些名词搞清楚。...
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    1565次阅读
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  • 发布了文章 2022-2-8 11:44

    AXI 总线交互分为 Master / Slave 两端
    在 AMBA 系列之 AXI 总线协议初探 中，了解到 AXI 总线交互分为 Master / Slave 两端，而且标准的 AXI 总线支持不同的位宽，既然是总线，那么必须要支持总线互联，多 Master，多 Slave的场景...
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    15460次阅读
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  • 发布了文章 2022-2-8 11:38

    总线、接口以及协议的含义
    在介绍AXI之前，先简单说一下总线、接口以及协议的含义。总线、接口和协议，这三个词常常被联系在一起，但是我们心里要明白他们的区别。...
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    7638次阅读
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  • 发布了文章 2022-2-8 11:35

    Vivado中关于ILA的详解
    集成逻辑分析仪 （Integrated Logic Analyzer ：ILA） 功能允许用户在 FPGA 设备上执行系统内调试后实现的设计。当设计中需要监视信号时，应使用此功能。用户还可以使用此功能在硬件事件和以系统速度捕获数据时触发。...
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    25515次阅读
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  • 发布了文章 2022-2-8 11:26

    正则表达式在Vivado约束文件中的应用
    我在xdc文件中匹配目标的时候，在可行的情况下更倾向于使用正则表达式。本文就介绍一下我常使用的正则表达式和一些在Vivado中应用的特殊之处，同时也有个别自己尚未解决的问题。...
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    2885次阅读
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  • 发布了文章 2022-2-8 11:18

    如何关联ELF输出文件并使用vivado对系统进行行为仿真
    本文介绍如何在教程(三)基础上, 关联ELF输出文件并使用vivado对系统进行行为仿真。...
    0
    6184次阅读
    0条评论
  • 发布了文章 2022-2-8 10:59

    PYNQ就是通过Python语言直接对FPGA进行编程吗
    PYNQ框架的设计初衷是通过高层次的封装，将底层硬件FPGA实现细节与上层应用层的使用脱耦，对软件开发者来说，PYNQ框架已经提供了完整的访问FPGA资源的library，让上层应用开发者通过Python编程就可以调用FPGA模块，不需要懂...
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