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广东省 深圳市 丨 设计开发工程
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  • 发布了文章 2022-2-8 17:08

    利用XILINX提供的FIFO IP进行读写测试
    FIFO是FPGA应用当中非常重要的模块，广泛用于数据的缓存，跨时钟域数据处理等。学好FIFO是FPGA的关键，灵活运用好FIFO是一个FPGA工程师必备的技能。本章主要介绍利用XILINX提供的FIFO IP进行读写测试。...
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  • 发布了文章 2022-2-8 16:42

    并行循环冗余校验算法
    循环冗余码校验（CRC）是一种众所周知的错误检测代码，已广泛用于以太网，PCIe和其他传输协议中。现有的基于FPGA的实现解决方案在高性能场景中会遇到资源过度利用的问题。填充零问题和可编程性的引入进一步加剧了这个问题。在本文中，提出了str...
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  • 发布了文章 2022-2-8 16:30

    如何使用FPGA内部的ROM以及程序对该ROM的数据读操作
    FPGA本身是SRAM架构的，断电之后，程序就消失，那么如何利用FPGA实现一个ROM呢，我们可以利用FPGA内部的RAM资源实现ROM，但不是真正意义上的ROM，而是每次上电都会把初始化的值先写入RAM。本实验将为大家介绍如何使用FPGA...
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  • 发布了文章 2022-2-8 16:02

    在BuildRelay中会调用Codegen函数
    接着上一章继续深入代码，在BuildRelay中会调用Codegen函数。这个函数实现在src/relay/backend/graph_runtime_codegen.cc中。Codegen实现了内存的分配，IR节点到TIR节点的转换，ti...
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  • 发布了文章 2022-2-8 15:51

    DDR PHY 与电路板调试
    Zynq UltraScale+ MPSoC VCU DDR 控制器是一款专用 DDR 控制器，只支持在 Zynq UltraScale+ MPSoC EV 部件上与 Zynq UltraScale+ MPSoC VCU（H.264/H.2...
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    1769次阅读
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  • 发布了文章 2022-2-8 15:50

    如何使用FPGA内部的RAM以及程序对该RAM的数据读写操作
    RAM是FPGA中常用的基础模块，可广泛用于缓存数据的情况，同样它也是ROM，FIFO的基础。本实验将为大家介绍如何使用FPGA内部的RAM以及程序对该RAM的数据读写操作。...
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    13920次阅读
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  • 发布了文章 2022-2-8 15:37

    从 Matchbox桌面关断PetaLinux BSP无法关断电路板
    使用 2018.2 Ultra96 PetaLinux BSP 构建图像时，如果我在 Matchbox 桌面点击关断图标，电路板不关断。服务器窗口会关闭，屏幕变为空白，但电路板还在运行。...
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    1036次阅读
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  • 发布了文章 2022-2-8 15:26

    如何在PL端开发程序
    在本例程中，我们要做的是LED灯控制实验，每秒钟控制开发板上的LED灯翻转一次，实现亮、灭、亮、灭的控制。会控制LED灯，其它外设也慢慢就会了。...
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    1787次阅读
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  • 发布了文章 2022-2-8 15:18

    几个Matlab编程中常用的优化技巧
    用过Matlab的同学应该都知道，Matlab的慢是出了名的，但是再慢也有优化的方式，下面我们给出几个Matlab编程中常用的优化技巧。...
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    3657次阅读
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  • 发布了文章 2022-2-8 15:13

    Vivado下PLL实验 ALINX
    很多初学者看到板上只有一个25Mhz时钟输入的时候都产生疑惑，时钟怎么是25Mhz？如果要工作在100Mhz、150Mhz怎么办？其实在很多FPGA芯片内部都集成了PLL，其他厂商可能不叫PLL，但是也有类似的功能模块，通过PLL可以倍频分...
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    4129次阅读
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  • 发布了文章 2022-2-8 15:09

    如何修改时钟频率
    为 VCU129 开发板提供的 BOARDUI.exe 可用于为板载 Si5348 时钟模块编写程序。默认频率为 156.25Mhz，该频率的设置文件在 BOARDUI 的 clockFiles 目录下提供。如何修改时钟频率？...
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  • 发布了文章 2022-2-8 15:04

    verilog基础模块的介绍
    本文主要介绍verilog基础模块，夯实基础，对深入学习FPGA会有很大帮助。...
    0
    2558次阅读
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  • 发布了文章 2022-2-8 14:51

    TVM的编译流程是什么
    TVM主要的编译过程如下图：Import：将tensorflow，onnx，pytorch等构建的深度学习模型导入，转化成TVM的中间层表示IR。Lower：将高层IR表示转化成低阶TIR表示。Codegen：内存分配和硬件可执行程序生成。...
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    1662次阅读
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  • 发布了文章 2022-2-8 14:44

    TVM中将计算算符分成四种
    算符融合将多个计算单元揉进一个计算核中进行，减少了中间数据的搬移，节省了计算时间。TVM中将计算算符分成四种： 1 injective。一一映射函数，比如加法，点乘等。 2 reduction。输入到输出具有降维性质的，比如sum。 ...
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    1992次阅读
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  • 发布了文章 2022-2-8 14:39

    典型的ZYNQ开发流程
    Zynq UltraScale+ MPSoC系列是Xilinx第二代Zynq平台。其亮点在于FPGA里包含了完整的ARM处理子系统（PS），包含了四核Cortex-A53处理器或双核Cortex-A53加双核Cortex-R5处理器，整个处...
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