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研究生 桂林电子科技大学
广西壮族自治区 桂林市 学术研究/学生
  • 回答了问题 2017-12-14 19:17

    FFT IP 核控制问题

    研究生 桂林电子科技大学
    问题解决了,是复位的问题,复位要循环,就是当一次FFT结束后要再次复位然后开始下一次变换
  • 回答了问题 2017-12-13 10:12

    FFT IP 核控制问题

    研究生 桂林电子科技大学
    FFT控制代码 module fft_control(clk,rst,rst_fifo,w_cycle,fftpts_in,sink_eop,sink_sop,sink_valid,start_16,fft16_over,switch,re_im,out_reim,count_in,recycle,re1,re2,enable)/*synthesis noprune*/; input ...
  • 回答了问题 2017-12-6 14:34

    fft ip核 仿真问题

    学生
    楼主问题解决没,我的也是出现这问题,不过我是直接在在线逻辑分析仪上观察的,也是没输出,输入都正常
  • 回答了问题 2017-10-11 08:47

    verilog状态机问题

    研究生 桂林电子科技大学
    嗯,我试试,新手编程,写的不规范,谢谢啊
  • 回答了问题 2017-10-11 08:47

    verilog状态机问题

    研究生 桂林电子科技大学
    嗯,我试试,新手编程,写的不规范,谢谢啊
  • 回答了问题 2017-10-11 08:47

    verilog状态机问题

    研究生 桂林电子科技大学
    嗯,我试试,新手编程,写的不规范,谢谢啊
  • 回答了问题 2017-10-8 21:12

    verilog状态机问题

    研究生 桂林电子科技大学
    正在审核通过
  • 回答了问题 2017-10-8 21:10

    verilog状态机问题

    研究生 桂林电子科技大学
  • 回答了问题 2017-10-8 21:09

    verilog状态机问题

    研究生 桂林电子科技大学
    module fft_control(clk,rst,/*re_fifo,*/wr_fifo,rst_fifo,w_cycle,wr_full1,wr_full2,wr_fifo1,wr_fifo2,fftpts_in,sink_eop,sink_sop,sink_valid,start_16,fft16_over,switch,re_im,out_reim,count_in,recycle, ...
  • 回答了问题 2017-10-7 10:45

    verilog状态机问题

    研究生 桂林电子科技大学
    嗯,谢谢啊,检查过了,应该不是这的问题
  • 回答了问题 2017-10-7 10:44

    verilog状态机问题

    研究生 桂林电子科技大学
    一直说要审核通过,传不上来
  • 回答了问题 2017-10-6 14:26

    verilog状态机问题

    研究生 桂林电子科技大学
    module fft_control(clk,rst,/*re_fifo,*/wr_fifo,rst_fifo,w_cycle,wr_full1,wr_full2,wr_fifo1,wr_fifo2,fftpts_in,sink_eop,sink_sop,sink_valid,start_16,fft16_over,switch,re_im,out_reim,count_in,recycle, ...
  • 回答了问题 2017-10-5 15:51

    FPGA串行数据输出问题

    研究生 桂林电子科技大学
    输出数据错误
  • 回答了问题 2017-10-5 15:50

    verilog状态机问题

    研究生 桂林电子科技大学
    module fft_control(clk,rst,/*re_fifo,*/wr_fifo,rst_fifo,w_cycle,wr_full1,wr_full2,wr_fifo1,wr_fifo2,fftpts_in,sink_eop,sink_sop,sink_valid,start_16,fft16_over,switch,re_im,out_reim,count_in,recycle, ...
  • 回答了问题 2017-10-5 14:17

    verilog状态机问题

    研究生 桂林电子科技大学
    module fft_control(clk,rst,/*re_fifo,*/wr_fifo,rst_fifo,w_cycle,wr_full1,wr_full2,wr_fifo1,wr_fifo2,fftpts_in,sink_eop,sink_sop,sink_valid,start_16,fft16_over,switch,re_im,out_reim,count_in,recycle, ...
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