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yes1

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黑金开发板

yes1

求黑金开发板 FPGA CYCLONE IV 系列 EP4CE6F17C8 配套光盘资料

来源：FPGA|CPLD|ASIC论坛
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16位并行前缀加法器

yes1

问一个蛮简单的问题，在做并行前缀加法器总是出现这个问题，到底是什么鬼，，应该怎样解决？谢谢了！end后面是调用部分~

来源：阿东Verilog技术专版
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加法器

yes1

请问下大家，，进位选择加法器和进位跳跃加法器的区别是啥啊？我用Verilog实现16位他们的加法器有什么样的不同啊？还请知道的大神告诉我一下。。

来源：电路设计论坛
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集成电路设计或相关方面有哪些顶级期刊

yes1

大家好，我是刚入门集成电路设计方面的研一新生，想了解一下学科内前沿动态，做做文献调研什么的，为以后科研打基础，可是苦于不知集成电路设计或相关方面有哪些顶级期刊，希望哪位行内高手能告知一下，多谢了! ...

来源：工程师杂谈|交友
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电源抑制比提高

yes1

现在正做一个折叠式共源共栅放大器的设计，性能指标增益和电源抑制比不能同时达到要求，各位大神帮忙告诉我怎么提高电源抑制比？另外，抑制电路到底是什么啊？最好有图呈现，谢谢了！ ...

来源：设计与制造封装测试
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毕查德·拉扎维

yes1

大家觉得毕查德·拉扎维的那本集成电路设计书怎么样？我今年刚考上这方面的研，可能需要在开学之前补点这方面的知识！求推荐

来源：电路设计论坛

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