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abcdsai
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    DDS相位累加器
    abcdsai
    设计时没有加入溢出清零的进程。频率累加字不断累加到最后应该是大于2的n方减1，溢出后应该要清零重新加吧。可是我没有加入这个进程，modelsim仿出的波形毫无问题。请问这是为什么呢？ 难道不要清零吗？可这样加下去 ...
    来源：FPGA|CPLD|ASIC论坛
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