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淡淡然ベ
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合肥工业大学
安徽省 合肥市 丨 设计开发工程
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主题 1 回帖 3

  • 3

    基于FPGA的除法器
    淡淡然ベ
    定点除法器的输出是商和余数的形式，但是我想让他表示成小数的形式（因为最后要送到数码管显示），该怎么装换？求大神，给点思路也可以！ 总共是8位显示，而整数部分和小数部分的位数不定？怎么设计 ...
    来源：FPGA|CPLD|ASIC论坛
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