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PSoC63有没有可能让引脚始终保持低电平?

我们正在使用 PSoC63(在 CYBLE-416045-02 模块上),并面临以下挑战:
我们需要将一个输出(端口 9.5)持续拉低,即使在控制器执行软复位时也是如此,因为硬件没有配备外部下拉电阻。
据我所知,每个 IO 引脚在复位时都处于三态,直到被配置为数字输出并被软件拉低。 在这短暂的时间间隙内,针脚是浮动的。 有没有可能让引脚始终保持低电平?

回帖(1)

殷谷光

2024-5-24 16:38:45
为了确保PSoC 63的引脚(端口9.5)始终保持低电平,即使在控制器执行软复位时,您可以尝试以下方法:

1. 使用外部下拉电阻:虽然您提到硬件没有配备外部下拉电阻,但您可以在外部电路中添加一个下拉电阻。将电阻连接到引脚和地之间,这将确保在复位期间引脚保持低电平。

2. 在启动代码中立即设置引脚:在PSoC 63的启动代码(通常在main函数之前执行的代码)中,立即设置端口9.5为输出并将其拉低。这可以确保在软件配置之前引脚保持低电平。

3. 使用硬件配置:在PSoC Creator中,您可以配置引脚的初始状态。在引脚配置对话框中,将初始状态设置为低电平。这将确保在软件配置之前引脚保持低电平。

4. 使用看门狗定时器:如果可能的话,您可以使用看门狗定时器在软复位期间保持引脚低电平。在看门狗定时器的中断服务例程中,立即设置端口9.5为输出并将其拉低。

5. 使用其他GPIO引脚:如果PSoC 63有其他GPIO引脚可以配置为输出并保持低电平,您可以尝试使用这些引脚来驱动端口9.5。这样,在软复位期间,另一个GPIO引脚可以保持端口9.5低电平。

请注意,这些方法可能需要根据您的具体硬件和软件环境进行调整。在实施这些解决方案时,请确保遵循PSoC 63和CYBLE-416045-02模块的规范和建议。
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