ST意法半导体
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ADC模块最小采样的时钟周期是多少
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ADC模块
最小采样时间为 2.5 个 ADC 时钟周期,最大 ADC 时钟为 80MHz,因此采样时间为 31.25ns,但您提到的为 18.75ns。在这里,我认为ST取的ADC时钟周期是1.5个。我觉得它是一个错误。
回帖
(1)
张璨
2022-12-28 14:36:05
句子有误,更正如下:
“低至 31.25ns 采样时间”或“低至 187.5ns 转换时间”
句子有误,更正如下:
“低至 31.25ns 采样时间”或“低至 187.5ns 转换时间”
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