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[问答]

对于模块内部上拉的引脚，为何需要用GPIO驱动三极管来控制而不用单片机GPIO直接控制

最近在使用一个5G通信的模块，其中有一个复位引脚，手册中是这样描述的：
RESET#是低电平有效的异步复位信号。当该引脚为低电平时，模块将开始进入复位状态。

拉低RESET#引脚250~600ms可复位模块。可使用NPN三极管、NMOS管驱动电路或按键控制 RESET#引脚。

既然引脚内部已经上拉，如果HOST的GPIO配置为开漏输出，是不是就不需要通过三极管/MOS管来控制复位信号，而可以直接控制RESET#引脚了？当需要低电平时，HOST直接输出低电平，Module的RESET#引脚接地，为低电平；当需要高电平时，HOST的GPIO设置为高，表现为高阻态，则Module的RESET引脚通过上拉电阻R1接VCC，为高电平。

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回帖（7）

噼哩啪啦噼哩啪啦

2022-5-9 15:59:34

想到一个可能的解释：是不是因为HOST单片机在上电的瞬间其GPIO引脚的输出电平不确定，有可能是低电平（本人对于单片机不是特别了解），所以为了防止误触发模块的复位，所以加上了MOS/三极管，只有GPIO为高电平时才能触发模块的复位。个人的一种可能的猜测，不知道对不对

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陈峰: 对对对对对对

烟台FPGA

2022-5-9 20:11:06

如果Host与Module的供电电源来自一路上，可以串联保护电阻直接连接。

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jiciwi

2022-5-10 08:40:37

你的理解也没有错；他这里的目的无非是想主机产生一个高电平来复位

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99714836

2022-5-10 09:55:33

可以的,只要你有一个最终端信号就可以触发复位,只要给芯片的控制触发信号就控制命令芯片状态转换.

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花不语怪风

2022-5-10 18:52:43

理论上看是可以的，内部有20K上拉，可以直接驱动，加Mos也可以，让外置MOS去模拟一个开关，目的都是要模块检测到Reset信号，使电路可靠的复位

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花不语怪风

2022-5-10 19:12:01

还有一种可能就是实现电平的转换，防止较大的电压灌进I/0

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小雨电子发烧友

2022-5-27 10:04:26

单片机输出和模块的输入电平有可能不一样，手册如果不严谨，直接使用会带来不可描述的异常，直接后果可能会损坏单片机和模块损坏。单片机I/O口是输出有高+低+不确定状态。输出一般还会加上拉或是下拉来固定输出状态。这个单片机手册一般会有说明

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