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malevolence
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请问如何用Verilog HDL语言实现以下要求的RS485通信?
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FPGA设计
`用
FPGA
开发板
和这个模块
实现
这样要求的485
通信
?真诚请教~~~
`
AN3485_UG.pdf
(1.41 MB)
(下载次数: 12, 2021-2-7 10:10 上传)
hiperface原版.pdf
(1.3 MB)
(下载次数: 8, 2021-2-7 10:10 上传)
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卿小小_9e6
2021-2-7 14:03:59
你参考板卡自带的DEMO程序,自己增加一个接收数据超时检测的功能即可。
你参考板卡自带的DEMO程序,自己增加一个接收数据超时检测的功能即可。
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