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【雨的FPGA笔记】基础实践-------流水灯设计和实现

本帖最后由 拾光333 于 2020-1-11 12:14 编辑

设计内容
       将4个LED每隔1s从左往右分别依次点亮熄灭，形成流水状。按复位键时进行复位，重新开始流水。
                                     4%FL5W@Y(`P~SLQ)RB8(XOT.png
流程
       FPGA的时钟频率为50MHz，所以要设置一个计数器就够，该计数器经历50 000 000个时钟周期，一个时钟周期20ns，共1s。设置一个Flag寄存器，计数达到要求数时产生一个高电压脉冲信号，LED检测到Flag信号进行流水操作。Flag信号目的在于仿真和下板的时候便于调试，代码书写良好规范。
循环过程led寄存器位拼接过程
                                     (NKX7G%MY8}295)R`8%6XH2.png
原理图
                                          16{@X%K`A0AR`4I1N7R[]8R.png
led有共阴和共阳的，这里是共阴，高电平有效。
管脚led0:   D11
       led1：C11
       led2:   E10
       led3：F9
仿真文件
  1. `timescale 1 ns/ 1 ns
  2. module light_water_vlg_tst();
  3. // constants                                          
  4. // general purpose registers
  5. // test vector input registers
  6. reg sys_clk;
  7. reg sys_rst;
  8. // wires                                               
  9. wire [3:0]  led;

  11. // assign statements (if any)                          
  12. light_water i1 (
  13.       .led(led),
  14.       .sys_clk(sys_clk),
  15.       .sys_rst(sys_rst)
  16. );
  17. initial                                                
  18. begin                                                  
  19.      sys_clk = 1'd0;
  20.      sys_rst = 1'd0;
  21.      #100 sys_rst = 1'd1;
  22.      #1000 $stop;                                                   
  23. end               
  24.                                     
  25. always                                                                  
  26. begin                                                  
  27.       #10 sys_clk = ~sys_clk;
  28.                                                                                                
  29. end                                                   
  30. endmodule
在仿真时将led变化缩短为6个时钟周期，也就是0~5计数，一个时钟周期为20ns，共120ns,便于观察
                               QQ图片20200111121212.png



回帖（2）

笼中葛

2020-1-11 14:23:37
好东西 值得拥有
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hdbaitao

2020-1-12 08:01:35
深度好文 值得推荐
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