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袁富存
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FPGA与DSP间的SRIO无法正确传输成功
FPGA
sRIO
CCS5.5
DSP 6657
FPGA
XC7Z030
FPGA 与 FPGA 之间SRIO传输成功;DSP 与 DSP 之间SRIO传输成功;
问题 : FPGA 与 DSP 之间 ,PORT OK 可以通过,可是就是无法正确传输成功。 这会是什么问题呢?会是什么原因导致的呢?需要注意什么地方呢?
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(4)
袁富存
2019-1-10 11:36:45
FPGA 做主, DSP 做从
FPGA 做主, DSP 做从
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袁富存
2019-1-10 11:53:37
终于调通了~我的妈呀
终于调通了~我的妈呀
举报
张宁
2019-1-10 12:03:59
引用:
冬冬5241 发表于 2019-1-10 15:33
终于调通了~我的妈呀
楼主能不能留个联系方式交流一下啊???希望研究FPGA 与DSP 之间SRIO通信的朋友们加QQ群74522342 ,一起讨论!
引用:
冬冬5241 发表于 2019-1-10 15:33
终于调通了~我的妈呀
楼主能不能留个联系方式交流一下啊???希望研究FPGA 与DSP 之间SRIO通信的朋友们加QQ群74522342 ,一起讨论!
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张宁
2019-1-10 12:16:10
引用:
冬冬5241 发表于 2019-1-10 15:33
终于调通了~我的妈呀
FPGA与DSP进行SRIO通信时,两边的时钟是否必须一致啊?
引用:
冬冬5241 发表于 2019-1-10 15:33
终于调通了~我的妈呀
FPGA与DSP进行SRIO通信时,两边的时钟是否必须一致啊?
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